參數(shù)資料
型號(hào)： MPC7400
廠商： Motorola, Inc.
英文描述： 32-Bit Microprocessor(32位微處理器)
中文描述： 32位微處理器（32位微處理器）
文件頁(yè)數(shù)： 639/646頁(yè)
文件大?。?/td> 7081K
代理商： MPC7400
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INDEX
Index
Index-11
BG,
8-8
,
9-10
BR,
8-8
,
9-10
CI,
8-14
,
9-19
CSE
n
,
8-23
data bus arbitration signals,
8-17
,
9-10
,
9-24
data transfer signals,
8-19
data transfer termination,
9-27
data transfer termination signals,
8-21
DBB,
8-19
,
9-10
,
9-25
DBG,
8-18
,
9-10
DBWO,
8-18
,
9-10
,
9-25
,
9-30
DH
n
/DL
n
,
8-19
DP
n
,
8-20
DRTRY,
8-23
,
9-27
GBL,
8-13
,
9-19
MPX bus mode compatibility,
8-22
overview,
8-6
SHD
n
,
8-17
,
9-24
signal state at hard reset,
8-5
signals multiplexed with MPX bus mode,
8-24
signals not implemented,
8-23
TA,
8-21
TBST,
8-12
,
9-26
TC
n
,
8-23
TEA,
8-22
,
9-27
,
9-29
transfer encoding,
9-16
TS,
8-11
TSIZ
n
,
8-13
,
9-17
TT
n
,
8-12
,
9-16
WT,
8-14
,
9-19
XATS,
8-23
address transfer attribute signals,
9-16
configuration,
8-6
GBL,
8-30
L2 cache interface signals,
8-39
MPX bus mode
60x bus mode compatibility,
8-22
AACK,
8-32
address arbitration,
8-26
address bus and parity signals,
8-28
address transfer attribute signals,
8-29
address transfer termination signals,
8-32
AMON,
8-27
A
n
,
8-28
AP
n
,
8-28
ARTRY,
8-32
,
9-45
BG,
8-27
BR,
8-27
CI,
8-31
data bus arbitration signals,
8-35
data transfer signals,
8-37
data transfer termination signals,
8-38
DBG,
8-35
DH
n
/DL
n
,
8-37
DMON,
8-37
DP
n
,
8-38
DRDY,
8-36
,
9-54
DTI
n
,
8-36
HIT,
8-34
,
9-48
overview,
8-24
SHD
n
,
8-33
,
9-47
signal state at hard reset,
8-5
signals multiplexed with 60x bus mode,
8-24
TA,
8-39
TBST,
8-30
TEA,
8-39
transfer type encodings,
9-43
TS,
8-29
TSIZ
n
,
8-30
,
9-43
TT
n
,
8-29
,
9-43
WT,
8-31
non-protocol specific
BVSEL,
8-51
CHK,
8-46
CKSTP_IN/CKSTP_OUT,
8-45
,
9-58
CLK_OUT,
8-49
clock control signals,
8-48
EMODE,
8-47
,
9-42
HRESET,
8-44
,
9-58
INT,
8-43
,
9-58
interrupts/reset signals,
8-43
JTAG interface,
8-49
,
9-60
L2 cache clock/control signals,
8-41
L2ADDR
n
,
8-40
L2CE,
8-41
L2CLK_OUTA,
8-42
L2CLK_OUTB,
8-42
L2DATA
n
,
8-40
L2DP,
8-40
L2SYNC_IN,
8-42
L2SYNC_OUT,
8-42
L2VSEL,
8-51
L2WE,
8-41
L2ZZ,
8-43
MCP,
8-44
overview,
8-39
PLL_CFG
n
,
8-49
power and ground signals,
8-52
processor status/control signals,
8-46
QACK,
8-47
,
9-59
QREQ,
8-47
,
9-59
RSRV,
8-46
,
9-59
SMI,
4-26
SMI,
8-43
SRESET,
8-44
,
9-58
SYSCLK,
8-48
8-46
TCK (JTAG test clock),
8-50
TDI (JTAG test data input),
8-50
TDO (JTAG test data output),
8-51
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