參數(shù)資料
型號： MPC7400
廠商： Motorola, Inc.
英文描述： 32-Bit Microprocessor(32位微處理器)
中文描述： 32位微處理器（32位微處理器）
文件頁數(shù)： 635/646頁
文件大小： 7081K
代理商： MPC7400
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INDEX
Index
Index-7
FP rounding and conversion,
2-47
,
A-28
FP status and control register,
2-48
FP store instructions,
A-33
FPSCR instructions,
A-29
multiply-add,
2-47
,
A-28
floating-point instructions execution
latencies,
6-43
flow control,
2-80
illegal instruction class,
2-38
implementation-specific instructions,
1-33
instruction cache throttling,
10-11
instruction flow diagram,
6-11
instruction serialization,
6-21
instruction set summary,
2-35
instruction timing,
6-33
instructions not implemented,
B-1
integer
arithmetic,
2-42
,
2-72
,
A-25
compare,
2-43
,
A-26
load,
A-30
load/store multiple,
A-32
load/store string,
A-32
load/store with byte reverse,
A-31
logical,
2-44
,
2-72
,
A-26
rotate and shift,
2-45
,
A-27
store,
A-31
integer instruction execution latencies,
6-41
isync,
4-13
latency summary,
6-39
load and store
address generation, floating-point,
2-54
address generation, integer,
2-50
byte reverse instructions,
2-53
,
A-31
execution latencies,
6-44
floating-point load,
A-32
floating-point move,
2-48
,
A-33
floating-point store,
2-55
handling misalignment,
2-49
integer load,
2-50
,
A-30
integer multiple,
2-53
integer store,
2-52
,
A-31
memory synchronization,
2-63
,
2-64
,
A-32
multiple instructions,
A-32
string instructions,
2-54
,
A-32
vector load,
2-79
lookaside buffer management instructions,
A-35
LRU instructions,
2-85
memory control instructions,
2-65
,
2-70
memory synchronization instructions,
2-63
,
2-64
,
A-32
move to/from VSCR register instructions,
2-84
PowerPC instructions,
1-30
PowerPC instructions, list,
A-1
,
A-13
,
A-25
processor control instructions,
2-59
,
2-64
,
2-69
,
A-34
reserved instruction class,
2-38
rfi,
4-13
segment register manipulation
instructions,
A-35
stwcx.,
4-13
support for lwarx/stwcx.,
9-59
sync,
4-13
synchronization,
2-40
system linkage instructions,
2-59
,
A-34
system register instruction latencies,
6-40
TLB management instructions,
A-35
trap instructions,
2-58
,
A-34
vector
floating-point arithmetic,
2-77
floating-point compare,
2-78
floating-point multiply-add,
2-77
floating-point rounding/conversion,
2-78
integer arithmetic,
2-73
,
A-36
integer compare,
2-75
integer logical,
2-76
integer rotate/shift,
2-76
load (alignment support),
2-80
load instructions,
A-38
memory control instructions,
2-84
merge instructions,
2-82
pack instructions,
2-81
,
A-39
permute instructions,
2-83
,
A-40
select instructions,
2-83
,
A-40
shift instructions,
A-40
splat instructions,
2-82
,
A-39
status and control register instructions,
2-84
store,
2-80
INT (interrupt) signal,
8-43
,
9-58
Integer
arithmetic instructions,
2-42
,
2-72
,
A-25
compare instructions,
2-43
,
A-26
integer unit execution timing,
6-29
load instructions,
2-50
,
A-30
logical instructions,
2-44
,
2-72
,
A-26
rotate/shift instructions,
2-45
,
A-27
store gathering,
6-31
,
7-16
store instructions,
2-52
,
A-31
Interrupt, external,
4-21
ISI exception,
4-20
isync,
2-65
,
4-13
ITLB organization,
5-25
IU
n
(integer units 1 and 2),
1-13
,
6-41
L
L1/L2 interface operation,
see
Cache
L2ADDR
n
(L2 address) signals,
8-40
L2CE (L2 chip enable) signals,
8-41
L2CLK_OUTA (L2 clock out A) signal,
8-42
L2CLK_OUTB (L2 clock out B) signal,
8-42
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PDF描述
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MPC801 32-Bit Microprocessor(32位微處理器)
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