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參數(shù)資料
| 型號(hào)： | MPC7400 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 32-Bit Microprocessor(32位微處理器) |
| 中文描述： | 32位微處理器（32位微處理器） |
| 文件頁(yè)數(shù)： | 15/646頁(yè) |
| 文件大?。?/td> | 7081K |
| 代理商： | MPC7400 |
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CONTENTS
Paragraph
Number
Title
Page
Number
Contents
xv
7.1.2.5.2
7.1.2.5.3
7.1.2.5.4
7.1.2.5.5
7.1.2.5.6
7.1.3
Data Stream Termination........................................................................ 7-8
Line Fetch Skipping................................................................................ 7-9
Context Awareness and Stream Pausing................................................ 7-9
Differences Between dst/dstt and dstst/dststt Instructions.................... 7-10
dss and dssall Instructions .................................................................... 7-10
AltiVec Instructions with Specific Implementations for
the MPC7400 ............................................................................................7-11
LRU Instructions ...................................................................................... 7-11
Java Mode, NaNs, Denormalized Numbers, and Zeros............................ 7-11
AltiVec Technology and the Cache Model....................................................... 7-15
AltiVec and the Exception Model..................................................................... 7-15
AltiVec and the Memory Management Model................................................. 7-16
AltiVec Technology and Instruction Timing.................................................... 7-16
Integer Store Gathering................................................................................. 7-16
7.1.3.1
7.1.3.2
7.2
7.3
7.4
7.5
7.5.1
Chapter 8
Signal Descriptions
8.1
8.1.1
8.1.2
8.2
8.2.1
8.2.2
8.2.2.1
8.2.2.2
8.2.2.3
8.2.3
8.2.3.1
8.2.3.1.1
8.2.3.1.2
8.2.3.2
8.2.3.2.1
8.2.3.2.2
8.2.4
8.2.4.1
8.2.4.1.1
8.2.4.1.2
8.2.4.2
8.2.4.2.1
8.2.4.2.2
8.2.4.3
Signal Groupings ................................................................................................ 8-1
Signal Summary.............................................................................................. 8-3
60x Bus and MPX Bus Output Signal States During Reset ........................... 8-5
60x Bus Signal Configuration............................................................................. 8-6
60x Bus Functional Groupings....................................................................... 8-6
Address Bus Arbitration Signals..................................................................... 8-8
Bus Request (
BR
)Output ........................................................................ 8-8
Bus Grant (
BG
)Input .............................................................................. 8-8
Address Bus Busy (
ABB
)Output............................................................ 8-9
Address Transfer Signals................................................................................ 8-9
Address Bus (A[0:31])................................................................................ 8-9
Address Bus (A[0:31])Output ............................................................ 8-9
Address Bus (A[0:31])Input............................................................. 8-10
Address Bus Parity (AP[0:3])................................................................... 8-10
Address Bus Parity (AP[0:3])Output................................................ 8-10
Address Bus Parity (AP[0:3])Input .................................................. 8-11
Address Transfer Attribute Signals............................................................... 8-11
Transfer Start (
TS
).................................................................................... 8-11
Transfer Start (
TS
)Output................................................................. 8-11
Transfer Start (
TS
)Input.................................................................... 8-12
Transfer Type (TT[0:4])........................................................................... 8-12
Transfer Type (TT[0:4])Output........................................................ 8-12
Transfer Type (TT[0:4])Input........................................................... 8-12
Transfer Burst (
TBST
)Output............................................................... 8-12
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