參數(shù)資料
型號： MPC106
廠商： Motorola, Inc.
英文描述： 32-Bit Microprocessor(32位微處理器)
中文描述： 32位微處理器（32位微處理器）
文件頁數(shù)： 8/398頁
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代理商： MPC106
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vi
MPC106 PCIB/MC User’s Manual
MOTOROLA
CONTENTS
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Number
Title
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Number
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2.2.5.2
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2.2.5.9.1
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2.2.5.11.1
2.2.5.11.2
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2.2.5.12.1
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2.2.5.13
2.2.5.13.1
2.2.5.13.2
2.2.5.14
2.2.5.14.1
2.2.5.14.2
2.2.5.14.3
2.2.5.14.4
2.2.6
2.2.6.1
2.2.6.2
2.2.6.3
2.2.6.4
2.2.6.5
Address/Data (AD[31–0])—Output......................................................2-33
Address/Data (AD[31–0])—Input.........................................................2-33
Command/Byte Enable (C/BE[3–0]).........................................................2-33
Command/Byte Enable (C/BE[3–0])—Output .....................................2-34
Command/Byte Enable (C/BE[3–0])—Input........................................2-34
Device Select (DEVSEL)..........................................................................2-35
Device Select (DEVSEL)—Output.......................................................2-35
Device Select (DEVSEL)—Input..........................................................2-35
Frame (FRAME)........................................................................................2-35
Frame (FRAME)—Output ....................................................................2-35
Frame (FRAME)—Input.......................................................................2-35
PCI Bus Grant (GNT)—Input ...................................................................2-35
Initiator Ready (IRDY)..............................................................................2-36
Initiator Ready (IRDY)—Output...........................................................2-36
Initiator Ready (IRDY)—Input.............................................................2-36
Lock (LOCK)—Input................................................................................2-36
Parity (PAR) ..............................................................................................2-36
Parity (PAR)—Output...........................................................................2-37
Parity (PAR)—Input..............................................................................2-37
Parity Error (PERR)...................................................................................2-37
Parity Error (PERR)—Output ...............................................................2-37
Parity Error (PERR)—Input..................................................................2-37
PCI Bus Request (REQ)—Output.............................................................2-37
System Error (SERR) ................................................................................2-38
System Error (SERR)—Output.............................................................2-38
System Error (SERR)—Input................................................................2-38
Stop (STOP)...............................................................................................2-38
Stop (STOP)—Output ...........................................................................2-38
Stop (STOP)—Input..............................................................................2-38
Target Ready (TRDY)...............................................................................2-38
Target Ready (TRDY)—Output............................................................2-38
Target Ready (TRDY)—Input...............................................................2-39
PCI Sideband Signals ................................................................................2-39
Flush Request (FLSHREQ)—Input.......................................................2-39
ISA Master (ISA_MASTER)—Input....................................................2-39
Memory Acknowledge (MEMACK)—Output......................................2-40
Modified Memory Interrupt Request (PIRQ)—Output.........................2-40
Interrupt, Clock, and Power Management Signals........................................2-40
Test Clock (CK0)—Output........................................................................2-40
Hard Reset (HRST)—Input.......................................................................2-40
Nonmaskable Interrupt (NMI)—Input ......................................................2-41
Quiesce Acknowledge (QACK)—Output.................................................2-41
Quiesce Request (QREQ)—Input..............................................................2-41
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PDF描述
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