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參數(shù)資料
| 型號： | MPC106 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 32-Bit Microprocessor(32位微處理器) |
| 中文描述： | 32位微處理器（32位微處理器） |
| 文件頁數(shù)： | 391/398頁 |
| 文件大?。?/td> | 1112K |
| 代理商： | MPC106 |
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MOTOROLA
Index
Index-5
INDEX
signals,
2-22
timings,
5-27
dirty bit,
5-2
external cache controller operation,
5-42
features list,
1-2
illegal L2 copy-back error,
9-6
internal cache controller operation,
5-9
overview,
1-4
,
5-1
parity support,
5-11
read data parity error,
9-7
response to bus operations,
5-12
signals,
2-19
SRAMs,
5-3
–
5-7
,
5-30
–
5-41
tag RAM and data RAM addressing,
5-10
timing examples,
5-30
vector relocation,
5-12
write-back
,
5-2
,
5-12
write-through
,
5-2
,
5-20
memory interface
buffer mode parameters,
6-2
configuration registers,
3-36
DRAM/EDO
address
multiplexing
,
6-9
interface operation,
6-7
SDRAM address multiplexing,
6-42
see also
DRAM/EDO interface
ECC error,
9-8
error detection,
9-7
errors within a
nibble
,
9-8
features list,
1-3
fetch
,
6-64
Flash interface
1-Mbyte Flash system,
6-62
cacheability restrictions,
6-63
description,
6-60
interface timing,
6-65
memory write timing,
6-68
parity/ECC signals,
6-6
single-byte read timing,
6-66
write operations,
6-67
Flash write error,
9-6
MICR
(memory
registers,
6-10
overview,
1-5
,
6-1
page
,
6-10
physical memory
,
9-7
power management support,
6-28
read data parity error,
9-7
refresh overflow error,
9-8
registers,
3-36
–
3-42
,
6-10
ROM interface
16-Mbyte ROM system,
6-61
burst read timing,
6-65
cacheability restrictions,
6-63
description,
6-60
interface
configuration)
interface timing,
6-63
SDRAM interface operation
configurations supported,
6-42
overview,
6-40
see also
SDRAM interface operation
select error,
9-8
signal buffering,
6-2
signals,
2-26
system memory
,
6-1
,
9-8
PCI
interface
address bus decoding,
7-6
,
A-7
address/data parity error,
7-13
,
9-8
big-endian mode,
B-3
burst operation,
7-3
bus arbitration,
7-3
bus commands,
7-4
bus error signals,
9-5
bus protocol,
7-3
bus transactions,
7-8
,
7-21
byte alignment,
7-8
,
B-2
byte ordering,
7-2
,
B-1
C/BE
n
signals,
7-25
cache wrap mode,
7-6
command encodings,
7-4
configuration cycles,
7-15
configuration header,
7-15
configuration space addressing,
7-7
data transfers,
7-3
,
7-8
error detection and reporting,
7-25
,
9-5
,
9-8
error transactions,
7-25
exclusive access,
7-23
fast back-to-back transactions,
7-14
features list,
1-3
I/O space addressing,
7-7
linear incrementing,
7-6
master-abort transaction termination,
7-11
,
9-9
memory space addressing,
7-6
MPC106 as PCI bus master,
7-2
MPC106 as PCI target,
7-2
nonmaskable interrupt,
2-41
,
9-10
overview,
1-6
,
7-1
,
7-1
PCI Local Bus Specification
,
xxvii
,
3-22
PCI special-cycle operations,
7-23
,
A-7
PCI System Design Guide
,
xxvii
,
3-22
PCI-to-ISA bridge,
7-27
PCI-to-system memory read buffer (PCMRB),
8-
5
PCI-to-system
memory
(PCMWBs),
8-5
processor-to-PCI read buffer (PRPRB),
8-4
processor-to-PCI-write buffers (PRPWBs),
8-5
read transactions,
7-9
registers,
3-22
,
7-16
,
9-9
retry
PCI transactions,
7-12
signals,
2-33
,
7-3
–
7-8
write
buffers
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MPC107 | 32-Bit Microprocessor(32位微處理器) |
| MPC505 | Highly Integrated, Low-Power, 32-Bit Microcontroller |
| MPC509 | Highly Integrated, Low-Power, 32-Bit Microcontroller |
| MPC5200BV400 | MPC5200 Hardware Specifications |
| MPC5200CBV266 | MPC5200 Hardware Specifications |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MPC106ARX66CE | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:PCI Bridge/Memory Controller |
| MPC106ARX66CG | 制造商:Freescale Semiconductor 功能描述: 制造商:Motorola Inc 功能描述: |
| MPC106ARX66DE | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:PCI Bridge/Memory Controller |
| MPC106ARX66DG | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:PCI Bridge/Memory Controller |
| MPC106ARX66TE | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:PCI Bridge/Memory Controller |
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