參數(shù)資料
型號(hào)： MPC106
廠商： Motorola, Inc.
英文描述： 32-Bit Microprocessor(32位微處理器)
中文描述： 32位微處理器（32位微處理器）
文件頁數(shù)： 285/398頁
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代理商： MPC106
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MOTOROLA
Chapter 6. Memory Interface
6-65
Figure 6-37. 64-Bit ROM/Flash Interface—Burst Read Timing
6.5.3 Eight-Bit ROM/Flash Interface Timing
The MPC106 provides programmable latency for accessing ROM/Flash memory so that
systems of various clock frequencies may properly interface to the ROM/Flash devices. The
programmable timing parameter MCCR1[ROMFAL] controls the access latency to
ROM/Flash memory. The actual latency cycle count is two cycles more than the value
specified in ROMFAL. For example, when ROMFAL = 0b0000, the latency is two clock
cycles; when ROMFAL = 0b0001, the latency is three clock cycles; when ROMFAL =
0b0010, the latency is four clock cycles; and so on. ROMFAL is set to its maximum value
at reset in order to accommodate initial boot code fetches from a slow device. To improve
access latency, it is recommended that initialization software program a more appropriate
value for the actual device being used. The 8-bit interface only provides nonburst access
timing, so the parameter MCCR1[BURST] is ignored for the 8-bit interface.
The following figures illustrate the 8-bit ROM/Flash interface timing for various read
accesses. Figure 6-38 shows a single-byte read access. Figure 6-39 shows a half-word read
access. Word and double-word accesses require using the burst access timing shown in
Figure 6-40.
60x Bus Clock
AR[19–20]
AR[1–18]
RCSn
60x Data
ROMFAL
Notes:
ROMFAL (ROM first access latency) = 0–15 clock cycles
ROMNAL (ROM next access latency) = 0–9 clock cycles
DATA0
DATA2
DATA3
Data sampled
ROMNAL
ROMNAL
ROMNAL
DATA1
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