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參數(shù)資料
| 型號： | MPC106 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 32-Bit Microprocessor(32位微處理器) |
| 中文描述： | 32位微處理器（32位微處理器） |
| 文件頁數(shù)： | 388/398頁 |
| 文件大?。?/td> | 1112K |
| 代理商： | MPC106 |
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Index-2
MPC106 PCIB/MC User's Manual
MOTOROLA
INDEX
AR
n
(ROM address) signals,
2-27
,
6-62
ARTRY (address retry) signal,
2-10
,
4-17
Asynchronous SRAMs
CF_DOE bit,
3-62
,
5-26
CF_WDATA bit,
3-62
,
5-26
CF_WMODE bit,
3-60
,
5-27
description,
5-6
L2 cache timing examples,
5-39
B
BA0 (burst address 0) signal,
2-20
BAA (bus address advance) signal,
2-20
Bank-activate command, SDRAM,
6-46
BCTL
n
(buffer control) signals,
2-27
,
6-2
BGL2 (external L2 bus grant) signal,
2-24
,
5-43
BG
n
(bus grant) signals,
2-11
,
2-25
,
4-7
Bibliography of additional reading,
xxvii
Big-endian
mode
accessing configuration registers,
3-17
byte lane translation,
B-2
byte ordering,
B-2
LE_MODE bit,
3-55
,
B-1
PCI memory space,
B-3
,
B-5
BIST (built-in self test) control register,
3-22
Boundary-scan registers,
C-2
BRL2 (external L2 bus request) signals,
2-24
,
5-43
BR
n
(bus request) signals,
2-11
,
2-26
,
4-7
Buffers
internal buffers
copy-back buffer,
8-2
PCI-to-system memory read buffer (PCMRB),
8-
5
PCI-to-system
memory
(PCMWBs),
8-5
processor-to-PCI-read buffer (PRPRB),
8-4
processor-to-PCI-write buffers (PRPWBs),
8-5
memory buffers
configurations, parameter settings,
6-2
flow-through buffers,
6-3
latch-type buffers,
6-4
mode/control signals,
6-2
registered buffers,
6-4
Burst
operations
60x data bus transfers
description,
4-14
normal termination,
4-19
64-bit data path,
6-19
burst ordering
60x data transfers,
4-14
PCI cache wrap mode,
7-6
PCI linear incrementing,
7-6
PCI bus transfer,
7-3
SDRAM-based systems,
6-43
Bus error status registers, 60x,
3-29
,
3-34
,
3-41
,
9-6
write
buffers
Bus interface unit (BIU), 60x,
B-1
Bus operations
60x processor interface
address tenure operations,
4-8
bus protocol,
4-6
data tenure operations,
4-18
L2 cache response,
5-12
PCI bus transactions,
7-8
Bypass register,
C-2
Byte
alignment,
6-62
,
7-8
,
B-1
byte enable signals,
2-33
,
7-8
,
7-25
ordering
60x bus,
B-1
big-endian mode,
B-2
least-significant byte (LSB)
,
B-1
little-endian mode,
B-5
most-significant byte/bit (MSB/msb)
,
B-1
PCI bus,
7-2
,
B-1
PCI alignment,
7-8
,
B-2
C
C/BE
n
(command/byte enable) signals,
2-33
,
7-8
,
7-
25
Cache wrap mode, PCI,
7-6
CAS
n
(column address strobe) signals,
2-28
,
6-9
,
6-29
CHRP (common hardware reference platform),
1-1
,
3-
1
CI (caching-inhibited) signal,
2-12
CK0 (test clock) signal,
2-40
CKE (SDRAM clock enable) signal,
2-28
Clock configuration
PLL
n
(clock mode) signals,
2-44
power management support,
A-6
Clock signals,
2-40
Commands
PCI commands
C/BE
n
signals,
2-33
,
7-4
interrupt-acknowledge transaction,
7-21
PCI command register,
3-23
,
7-16
special-cycle command,
7-22
SDRAM commands
command encodings,
6-47
JEDEC standard commands,
6-46
mode-set command,
6-55
mode-set commands,
6-47
Common hardware reference platform (CHRP),
1-
1
,
3-1
Completion, PCI transaction,
7-11
Configuration
configuration registers
60x bus error status registers,
3-29
,
3-34
,
3-41
,
9-
6
60x/PCI error address register,
3-36
,
9-6
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MPC107 | 32-Bit Microprocessor(32位微處理器) |
| MPC505 | Highly Integrated, Low-Power, 32-Bit Microcontroller |
| MPC509 | Highly Integrated, Low-Power, 32-Bit Microcontroller |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| MPC106ARX66DE | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:PCI Bridge/Memory Controller |
| MPC106ARX66DG | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:PCI Bridge/Memory Controller |
| MPC106ARX66TE | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:PCI Bridge/Memory Controller |
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