- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄369923 > MPC106 (Motorola, Inc.) 32-Bit Microprocessor(32位微處理器) PDF資料下載
參數(shù)資料
| 型號： | MPC106 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 32-Bit Microprocessor(32位微處理器) |
| 中文描述： | 32位微處理器（32位微處理器） |
| 文件頁數(shù)： | 36/398頁 |
| 文件大?。?/td> | 1112K |
| 代理商： | MPC106 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁當(dāng)前第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁第248頁第249頁第250頁第251頁第252頁第253頁第254頁第255頁第256頁第257頁第258頁第259頁第260頁第261頁第262頁第263頁第264頁第265頁第266頁第267頁第268頁第269頁第270頁第271頁第272頁第273頁第274頁第275頁第276頁第277頁第278頁第279頁第280頁第281頁第282頁第283頁第284頁第285頁第286頁第287頁第288頁第289頁第290頁第291頁第292頁第293頁第294頁第295頁第296頁第297頁第298頁第299頁第300頁第301頁第302頁第303頁第304頁第305頁第306頁第307頁第308頁第309頁第310頁第311頁第312頁第313頁第314頁第315頁第316頁第317頁第318頁第319頁第320頁第321頁第322頁第323頁第324頁第325頁第326頁第327頁第328頁第329頁第330頁第331頁第332頁第333頁第334頁第335頁第336頁第337頁第338頁第339頁第340頁第341頁第342頁第343頁第344頁第345頁第346頁第347頁第348頁第349頁第350頁第351頁第352頁第353頁第354頁第355頁第356頁第357頁第358頁第359頁第360頁第361頁第362頁第363頁第364頁第365頁第366頁第367頁第368頁第369頁第370頁第371頁第372頁第373頁第374頁第375頁第376頁第377頁第378頁第379頁第380頁第381頁第382頁第383頁第384頁第385頁第386頁第387頁第388頁第389頁第390頁第391頁第392頁第393頁第394頁第395頁第396頁第397頁第398頁
MOTOROLA
Chapter 1. Overview
1-5
When more than one 60x processor is used, nine signals of the L2 interface change their
functions (to BR[1–3], BG[1–3], and DBG[1–3]) to allow for arbitration between the 60x
processors. The 60x processors share all 60x interface signals of the MPC106, except the
bus request, bus grant, and data bus grant signals.
When an external L2 controller (or integrated L2 cache module) is used, three signals of the
L2 interface change their functions (to BRL2, BGL2, and DBGL2) to allow the MPC106
to arbitrate between the external cache and the 60x processor(s).
1.2.3 Memory Interface
The memory interface controls processor and PCI interactions to main memory and is
capable of supporting a variety of DRAM, extended data-out (EDO) DRAM, or
synchronous DRAM (SDRAM) and ROM or Flash ROM configurations as main memory.
The maximum supported memory size is 1 Gbyte of DRAM/EDO/SDRAM, with 16
Mbytes of ROM/Flash. The MPC106 configures its memory controller to support the
various memory sizes through software initialization of on-chip configuration registers.
Parity (DRAM/EDO/SDRAM) or ECC (DRAM/EDO-only) is provided for error
detection.
The MPC106 controls the 64-bit data path to main memory (72 bits with parity or ECC).
To reduce loading on the data bus, system designers may need to add buffers between the
60x bus and memory. The MPC106 features configurable data/parity buffer control logic to
accommodate several buffer types.
The MPC106 supports a variety of DRAM/EDO/SDRAM configurations. DRAM/EDO/
SDRAM banks can be built using dual in-line memory modules (DIMMs), single in-line
memory modules (SIMMs), or directly-attached memory devices. Thirteen multiplexed
address signals provide for device densities up to 16 M. Eight row address strobe/command
select (RAS/CS[0–7]) signals support up to eight banks of memory. The MPC106 supports
bank sizes from 2 Mbytes to 128 Mbytes. Eight column address strobe/data qualifier (CAS/
DQM[0–7]) signals are used to provide byte selection for memory bank accesses.
The MPC106 supports parity checking and generation in two forms—normal parity and
read-modify-write (RMW) parity. As an alternative to simple parity, the MPC106 supports
error checking and correction (ECC) for DRAM/EDO configurations. Using ECC, the
MPC106 detects and corrects all single-bit errors and detects all double-bit errors and all
errors within a nibble.
For ROM/Flash support, the MPC106 provides 20 address bits (21 address bits for the 8-bit
wide ROM interface), two bank selects, one output enable, and one Flash write enable. The
16-Mbyte system ROM space is subdivided into two 8-Mbyte banks. Bank 0 (selected by
RCS0) is addressed from 0xFF80_0000 to 0xFFFF_FFFF. Bank 1 (selected by RCS1) is
addressed from 0xFF00_0000 to 0xFF7F_FFFF. A configuration signal (FOE) sampled at
reset, determines the bus width of the ROM or Flash device (8-bit or 64-bit) in bank 0. The
data bus width for ROM bank 1 is always 64 bits. For systems using the 8-bit interface to
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MPC107 | 32-Bit Microprocessor(32位微處理器) |
| MPC505 | Highly Integrated, Low-Power, 32-Bit Microcontroller |
| MPC509 | Highly Integrated, Low-Power, 32-Bit Microcontroller |
| MPC5200BV400 | MPC5200 Hardware Specifications |
| MPC5200CBV266 | MPC5200 Hardware Specifications |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MPC106ARX66CE | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:PCI Bridge/Memory Controller |
| MPC106ARX66CG | 制造商:Freescale Semiconductor 功能描述: 制造商:Motorola Inc 功能描述: |
| MPC106ARX66DE | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:PCI Bridge/Memory Controller |
| MPC106ARX66DG | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:PCI Bridge/Memory Controller |
| MPC106ARX66TE | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:PCI Bridge/Memory Controller |
發(fā)布緊急采購，3分鐘左右您將得到回復(fù)。