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參數(shù)資料
| 型號： | MPC106 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 32-Bit Microprocessor(32位微處理器) |
| 中文描述： | 32位微處理器（32位微處理器） |
| 文件頁數(shù)： | 10/398頁 |
| 文件大?。?/td> | 1112K |
| 代理商： | MPC106 |
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viii
MPC106 PCIB/MC User’s Manual
MOTOROLA
CONTENTS
Paragraph
Number
Title
Page
Number
3.2.8
3.2.9
3.2.9.1
3.2.10
Alternate OS-Visible Parameters Registers...................................................3-63
Emulation Support Configuration Registers..................................................3-64
Modified Memory Status Register.............................................................3-66
External Configuration Registers...................................................................3-67
Chapter 4
Processor Bus Interface
4.1
4.1.1
4.1.2
4.1.3
4.1.4
4.2
4.2.1
4.2.2
4.3
4.3.1
4.3.2
4.3.2.1
4.3.2.2
4.3.2.3
4.3.2.4
4.3.3
4.3.3.1
4.3.3.2
4.4
4.4.1
4.4.2
4.4.3
4.4.4
4.4.5
4.4.5.1
MPC106 Processor Bus Configuration................................................................4-1
Single-Processor System Configuration..........................................................4-1
Multiprocessor System Configuration.............................................................4-3
Multiprocessor System Configuration with External L2 Cache......................4-4
Processor Bus Interface Configuration Registers............................................4-5
Processor Bus Protocol Overview .......................................................................4-6
MPC106 Arbitration........................................................................................4-7
Address Pipelining and Split-Bus Transactions...............................................4-7
Address Tenure Operations..................................................................................4-8
Address Arbitration..........................................................................................4-8
Address Transfer Attribute Signals................................................................4-10
Transfer Type Signal Encodings ...............................................................4-10
TBST and TSIZ[0–2] Signals and Size of Transfer ..................................4-13
Burst Ordering During Data Transfers......................................................4-14
Effect of Alignment on Data Transfers .....................................................4-14
Address Transfer Termination.......................................................................4-16
MPC106 Snoop Response .........................................................................4-17
Address Tenure Timing Configuration......................................................4-18
Data Tenure Operations.....................................................................................4-18
Data Bus Arbitration......................................................................................4-18
Data Bus Transfers and Normal Termination................................................4-19
Data Tenure Timing Configurations..............................................................4-19
Data Bus Termination by TEA......................................................................4-19
60x Local Bus Slave Support.........................................................................4-21
60x Local Bus Slave Timing .....................................................................4-21
Chapter 5
Secondary Cache Interface
5.1
5.1.1
5.1.2
5.1.3
5.1.4
5.1.5
L2 Cache Configurations.....................................................................................5-2
Write-Back Cache Operation...........................................................................5-2
Write-Through Cache Operation.....................................................................5-2
Synchronous Burst SRAMs.............................................................................5-3
Pipelined Burst SRAMs...................................................................................5-4
Asynchronous SRAMs ....................................................................................5-6
相關PDF資料 |
PDF描述 |
|---|---|
| MPC107 | 32-Bit Microprocessor(32位微處理器) |
| MPC505 | Highly Integrated, Low-Power, 32-Bit Microcontroller |
| MPC509 | Highly Integrated, Low-Power, 32-Bit Microcontroller |
| MPC5200BV400 | MPC5200 Hardware Specifications |
| MPC5200CBV266 | MPC5200 Hardware Specifications |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MPC106ARX66CE | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:PCI Bridge/Memory Controller |
| MPC106ARX66CG | 制造商:Freescale Semiconductor 功能描述: 制造商:Motorola Inc 功能描述: |
| MPC106ARX66DE | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:PCI Bridge/Memory Controller |
| MPC106ARX66DG | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:PCI Bridge/Memory Controller |
| MPC106ARX66TE | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:PCI Bridge/Memory Controller |
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