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參數(shù)資料
| 型號： | V4ECFUM |
| 英文描述： | ColdFire CF4e Core User＇s Manual |
| 中文描述： | 核心的ColdFire CF4e用戶手冊 |
| 文件頁數(shù)： | 254/372頁 |
| 文件大小： | 4286K |
| 代理商： | V4ECFUM |
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10-22
ColdFire CF4E Core User’s Manual
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MMU Instructions
For TLB miss faults, the instruction restart model completely reexecutes an instruction
on returning from the exception handler. An instruction can touch two instruction pages (a
32- or 48-bit instruction can straddle two pages) or four data pages (a memory-to-memory
word or longword move where misaligned source and destination operands straddle two
pages). Therefore, one instruction may take two ITLB misses and allocate two ITLB pages
before completion. Likewise, one instruction may require four DTLB misses and allocate
four DTLB pages. Because of this, a pool of unlocked TLB entries must be available if
virtual memory is used.
The above examples show the fewest entries needed to guarantee an instruction can
complete execution. For good MMU performance, more unlocked TLB entries should
be available.
Figure 10-11. Version 4 ColdFire MMU Harvard TLB
10.7 MMU Instructions
The MOVE to USP and MOVE from USP instructions have been added for accessing the
USP. Refer to the
PRM
for more information.
KC1
J
Current address space ID (ASID)
Instruction or data K-Bus address and attributes
Compare
IC1 or OC1 translated address
IC1 or OC1 access control
TLB Tag
Entry 31
TLB Tag
Entry 0
TLB Tag
Entry 31
TLB Tag
Entry 0
To K-Bus control for instruction or
DTLB miss logic
Instruction or dataK-Bus hit
select
Compare
F
Freescale Semiconductor, Inc.
n
.
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| V4FFS12V40A | 制造商:TDK 功能描述:Vega universal input SMPSU,12V 450W |
| V4FFS24V15A | 制造商:TDK 功能描述:Vega universal input SMPSU,24V 450W |
| V4FFS5V60A,12V12A,12V12A,24V6 | 制造商:TDK 功能描述:Vega univ input SMPSU,5/2x12/24V 450W |
| V4FFS5Z18F12C3F12B3F | 制造商:TDK 功能描述:Vega universal input SMPSU,5/2x12V 450W |
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