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參數(shù)資料
| 型號(hào)： | V4ECFUM |
| 英文描述： | ColdFire CF4e Core User＇s Manual |
| 中文描述： | 核心的ColdFire CF4e用戶手冊(cè) |
| 文件頁(yè)數(shù)： | 154/372頁(yè) |
| 文件大?。?/td> | 4286K |
| 代理商： | V4ECFUM |
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7-8
ColdFire CF4E Core User’s Guide
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Precise Faults
7.5 Precise Faults
To support a demand-paged virtual memory environment, all memory references require
precise, recoverable faults. The ColdFire instruction restart mechanism ensures that a
faulted instruction restarts from the beginning of execution; that is, no internal state
information is saved when an exception occurs and none is restored when the handler ends.
Given the PC address defined in the exception stack frame, the processor reestablishes
program execution by transferring control to the given location as part of the RTE (return
from exception) instruction.
The instruction restart recovery model requires program-visible register changes made
during execution to be undone if that instruction subsequently faults.
The Version 4 (and later) OEP structure naturally supports this concept for most
instructions; program-visible registers are updated only in the final OEP stage when fault
collection is complete. If any type of exception occurs, pending register updates are
discarded.
For V4 cores and later, most single-cycle instructions already support precise faults and
instruction restart. Some complex instructions do not. Consider the following
memory-to-memory move:
mov.l
(Ay)+,(Ax)+
# copy 4 bytes from source to destination
On a Version 4 processor, this instruction takes one cycle to read the source operand (Ay)
and one to write the data into Ax. Both the source and destination address pointers are
updated as part of execution. Table 7-4 lists the operations performed in execute stage (EX).
A fault detected with the destination memory write is reported during the second cycle. At
this point, operations performed in the first cycle are complete, so if the destination write
takes any type of access error, Ay is updated. After the access error handler executes and
the faulting instruction restarts, the processor’s operation is incorrect because the source
address register has an incorrect (post-incremented) value.
To recover the original state of the programming model for all instructions, the CF4eCpu
adds the needed hardware to support full register recovery. This hardware allows
program-visible registers to be restored to their original state for multi-cycle instructions so
that the instruction restart mechanism is supported. Memory-to-memory moves and move
multiple loads are representative of the complex instructions needing the special recovery
support.
The other major pipeline change affects the IFP. The IFP and OEP are decoupled by a FIFO
Table 7-4. OEP EX Cycle Operations
EX Cycle
Operations
1
Read source operand from memory @ (Ay), update Ay, new Ay = old Ay + 4
2
Write operand into destination memory @ (Ax), update Ax, new Ax = old Ax + 4, update CCR
F
Freescale Semiconductor, Inc.
n
.
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