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參數(shù)資料
| 型號(hào)： | PowerPC 601 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 32-Bit Microprocessor(32位微處理器) |
| 中文描述： | 32位微處理器（32位微處理器） |
| 文件頁(yè)數(shù)： | 172/250頁(yè) |
| 文件大小： | 916K |
| 代理商： | POWERPC 601 |
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A-2
PowerPC Microprocessor Family: The Bus Interface for 32-Bit microprocessors
Differences in programming model (for example, implementation-specific special-purpose
registers) are described in the user’s manual for each device.
Slight differences in TC encodings
—
—
—
Data bus disable signal
No
Yes
Yes
TA required during last DRTRY
No
Yes
Yes
Snoop response signals
ARTRY, SHD
ARTRY
ARTRY, SHD
Misaligned within double word that
crosses word causes two accesses
No
Yes
Yes
Time base source
RTC input
System clock
System clock
Time base enable
RTC
TBEN
TBEN
Power management
—
Several modes
Nap mode
Power management signals
—
QREQ, QACK
RUN, HALTED
DBWO only with pending read
Nothing
Transfer read
Transfer read
Data mirroring on CI writes
Yes
No
Unspecified
Early ARTRY data tenure termination
No
Yes
Yes
Processor ID value in PIO
From PID register
Zero
From PID register
Snoop for misplaced PIO reply
Yes
No
No
32-bit data transfer mode
No
Yes
No
Reduced pinout mode
No
Yes
No
CKSTP_OUT asserted, outputs high
impedance for CKSTP_IN assertion
No
Yes
Yes
Optional machine check for checkstop
condition
No
Yes
Yes
Cancel reservation on snooped RWITM Yes
No
Yes
Snoop nonglobal transactions for
reservation cancellation
No
Yes
No
stwcx.
treated as write-through
No
Yes
No
WT state on snoop push
See Section 2.4.7,
“Transfer Code (TCn)—
Output”
See Section 2.4.7,
“Transfer Code (TCn)—
Output”
See Section 2.4.7,
“Transfer Code (TCn)—
Output”
Table A-1. Bus and Memory Coherency Behavior Summary (Continued)
Functionality
601
603
604
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