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參數(shù)資料
| 型號(hào)： | DSP16410C |
| 英文描述： | TVS 400W 7.0V UNIDIRECT SMA |
| 中文描述： | DSP1629數(shù)字信號(hào)處理器 |
| 文件頁(yè)數(shù)： | 310/373頁(yè) |
| 文件大?。?/td> | 5643K |
| 代理商： | DSP16410C |
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Data Sheet
June 2001
DSP16410B Digital Signal Processor
254
Agere Systems—Proprietary
Use pursuant to Company instructions
Agere Systems Inc.
7 Ball Grid Array Information
(continued)
7.2 256-Ball EBGA Package
(continued)
Table 174 describes the EBGA ball assignments sorted by symbol for the 256-ball package. For each signal or
power/ground connection, this table lists the EBGA coordinate, the symbol name, the type (I = input, O = output,
I/O = input/output, O/Z = 3-state output, P = power, G = ground), and description. Inputs and bidirectional pins do
not maintain full CMOS levels when not driven. They must be pulled to V
DD
2
or V
SS
through the appropriate pull
up/down resistor (refer to
Section 10.1 on page 269
). An unused external SEMI data bus (ED[31:0]) can be stati-
cally configured as outputs by asserting the EYMODE pin. At full CMOS levels, no significant dc current is drawn.
Table 174. 256-Ball EBGA Ball Assignments Sorted Alphabetically by Symbol
Symbol
PBGA
Coordinate
J19
Type
Description
CKI
I
External Clock Input.
External Address Bus, Bits 18—0.
EA[18:0]
B3, C1, C2, C4, D1, D2, D5, E2, E3, E4, F3,
F4, G2, G3, H2, H3, H4, J3, J4
C6
O
EACKN
O
External Device Acknowledge for External Memory Inter-
face (negative assertion).
Programmable Clock Output.
External Memory Data Bus, Bits 31—0.
ECKO
ED[31:0]
M1
O
I/O
A8, A9, A10, A14, A17, A18, B6, B8, B9, B10,
B11, B12, B13, B14, B16, B17, C8, C11, C12,
C13, C14, C15, C16, C19, C20, D7, D10, D15,
D16, D18, D19, E17
A3
B4
F17
D20
EION
ERAMN
ERDY
EREQN
O
O
I
I
Enable for External I/O (negative assertion).
External RAM Enable (negative assertion).
External Memory Device Ready.
External Device Request for EMI Interface (negative
assertion).
Enable for External ROM (negative assertion).
EROM Type Control:
If 0, asynchronous SRAM mode.
If 1, synchronous SRAM mode.
Read/Write, Bit 0 (negative assertion).
Read/Write, Bit 1 (negative assertion).
External Segment Address, Bits 3—0.
External Memory Bus Size Control:
If 0, 16-bit external interface.
If 1, 32-bit external interface.
External Boot-up Control for CORE0.
External Data Bus Mode Configuration Pin.
External Interrupt Requests 3—0.
BIO0 Status/Control, Bits 6—0.
BIO1 Status/Control, Bits 6—0.
PIU Address, Bits 3—0.
PIU Chip Select (negative assertion).
PIU Data Bus, Bits 15—0.
EROMN
ERTYPE
D6
G17
O
I
ERWN0
ERWN1
ESEG[3:0]
ESIZE
B5
A4
O
O
O
I
K2, L1, L2, L4
E19
EXM
EYMODE
INT[3:0]
IO0BIT[6:0]
IO1BIT[6:0]
PADD[3:0]
PCSN
PD[15:0]
F18
U16
I
I
I
K18, L18, L19, M18
R17, R18, T18, T19, U19, U20, W18
T4, U3, U5, V2, V5, W4, Y3
U6, V6, W5, Y4
V7
U11, U14, U15, V13, V15, W11, W12, W13,
W15, W16, W17, Y11, Y12, Y13, Y17, Y18
W10
Y7
W9
V10
V8
I/O
I/O
I
I
I/O
PIBF
PIDS
PINT
POBE
PODS
O
I
O
O
I
PIU Input Buffer Full Flag.
PIU Input Data Strobe.
PIU Interrupt Request to Host.
PIU Output Buffer Empty Flag.
PIU Output Data Strobe.
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