參數(shù)資料
型號(hào)： DSP16410C
英文描述： TVS 400W 7.0V UNIDIRECT SMA
中文描述： DSP1629數(shù)字信號(hào)處理器
文件頁(yè)數(shù)： 134/373頁(yè)
文件大?。?/td> 5643K
代理商： DSP16410C
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Data Sheet
June 2001
DSP16410B Digital Signal Processor
78
Agere Systems—Proprietary
Use pursuant to Company instructions
Agere Systems Inc.
4 Hardware Architecture
(continued)
4.13 Direct Memory Access Unit (DMAU)
(continued)
4.13.2 Registers
(continued)
Table 40. DCNT
0—3
(SWT
0—3
Destination Counter) Registers
See
Table 29 starting on page 66
for the memory addresses of these registers.
19—7
DROW[12:0]
Table 41. DCNT
4—5
(MMT
4—5
Destination Counter) Registers
See
Table 29 starting on page 66
for the memory addresses of these registers.
19—7
DROW[12:0]
6—0
DCOL[6:0]
Bit
Field
Description
R/W
Reset
Value
X
19—7
DROW[12:0]
The row counter of the one-dimensional or two-dimensional destination array
for the corresponding SWT channel (write data). The DMAU updates this
field as the transfer proceeds and automatically clears it upon the completion
of the transfer.
The column counter of the one-dimensional or two-dimensional destination
array for the corresponding SWT channel (write data). The DMAU updates
this field as the transfer proceeds and automatically clears it upon the com-
pletion of the transfer.
For this column, X indicates unknown on powerup reset and unaffected on subsequent reset.
DCNT
0—3
are not cleared by a reset of the DMAU
channel via the
DMCON1
register (
Table 32 on page 71
). Before an SWT channel can be used, the program must clear the corresponding
DCNT
0—3
register after a DSP16410B device reset. Otherwise, the value of this register is undefined.
R/W
6—0
DCOL[6:0]
R/W
X
6:0
DCOL[6:0]
Bit
Field
Description
R/W
Reset
Value
X
19—7
DROW[12:0]
The row counter of the destination block for the corresponding MMT channel
(write data). The DMAU increments this field as the transfer proceeds and
automatically clears it upon the completion of the transfer.
The column counter of the destination block for the corresponding MMT
channel (write data). Typically, the user has programmed the LASTCOL[6:0]
field (
LIM
4—5
[6:0]—
Table 43 on page 79
) with zero and therefore the
DMAU does not update this field.
For this column, X indicates unknown on powerup reset and unaffected on subsequent reset.
DCNT
4—5
are not cleared by a reset of the DMAU
channel via the
DMCON1
register (
Table 32 on page 71
). Before an MMT channel can be used, the program must clear the corresponding
DCNT
4—5
register after a DSP16410B device reset. Otherwise, the value of this register is undefined.
R/W
6—0
DCOL[6:0]
R/W
X
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PDF描述
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