參數(shù)資料
型號： DSP16410C
英文描述： TVS 400W 7.0V UNIDIRECT SMA
中文描述： DSP1629數(shù)字信號處理器
文件頁數(shù)： 265/373頁
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代理商： DSP16410C
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Data Sheet
June 2001
DSP16410B Digital Signal Processor
Agere Systems Inc.
Agere Systems—Proprietary
Use pursuant to Company instructions
209
6 Software Architecture
(continued)
6.1 Instruction Set Quick Reference
(continued)
Table 129. Instruction Set Summary
Instruction
Flags
szlme
Cycles
Out
Words
In
Multiply/Accumulate (MAC) Group
F1
F1
F1
F1
F1
F1
F1
yh = aTh
F1
if CON
F1E
F1E
y
h,l
=
aTE
h,l
F1E
aTE
h,l
=
y
h,l
F1E
y = aE_Ph
F1E
aE_Ph = y
F1E
F1E
F1E
F1E
F1E
F1E
F1E
F1E
F1E
y
h
=
*r0
F1E
F1E
F1E
F1E
F1E
y = aE_Ph
F1E
y
h
= aTE
h
F1E
aTE
h
= y
h
F1E
F1E
F1E
F1E
F1E
F1E
F1E
Y
x
h,l
= Y
y
h,l
= Y
a
h,l
= Y
Y = y
h,l
Y = aT
h,l
szlm–
szlm–
szlm–
szlm–
szlm–
szlm–
szlm–
szlm–
szlme
szlme
szlme
szlme
szlme
szlme
szlme
szlme
szlme
szlme
szlme
szlme
szlme
szlme
szlme
szlme
szlme
szlme
szlme
szlme
szlme
szlme
szlme
szlme
szlme
szlme
szlme
szlme
1
1
1
xh = X
xh = X
1+X
C
yh = Y
1
1
2
x
h,l
= YE
y
h,l
= YE
aTE
h,l
= YE
aE_Ph = YE
YE = x
h,l
YE = y
h,l
YE = aTE
h,l
YE = aE_Ph
r0 = rNE + jhb
YE
x
h,l
=
XE
aTE
h,l
= XE
aE_Ph = XE
x
h
=
XE
x
h
=
XE
x
h
=
XE
a4
h
= XE
x
h
= XE
x
h
=
XE
a4_5h = XE
x
h
= XE
x
h
=
XE
a4
h
=
XE
1+X
C
y
h,l
=
YE
y
h,l
= YE
YE = y
h,l
y
h
= YE
YE = a6_7h
YE = a6
h
YE = a6
h
X
C
is one cycle if XAAU contention occurs and zero cycles otherwise. XAAU contention occurs frequently for these instruc-
tion types and can only be avoided by use of the cache.
For this transfer, the postincrement options
*rME
and
*rME––
are not available
for double-word loads.
§ The – (40-bit subtraction) operation is encoded as
aDE=aSE+IM16
with the IM16 value negated.
For conditional branch instructions, the execution time is two cycles if the branch is not taken.
The instruction performs the same function whether or not
near
(optional) is included.
§§ Not including the N instructions.
D
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