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參數(shù)資料
| 型號： | DSP16410C |
| 英文描述： | TVS 400W 7.0V UNIDIRECT SMA |
| 中文描述： | DSP1629數(shù)字信號處理器 |
| 文件頁數(shù)： | 292/373頁 |
| 文件大?。?/td> | 5643K |
| 代理商： | DSP16410C |
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Data Sheet
June 2001
DSP16410B Digital Signal Processor
236
Agere Systems—Proprietary
Use pursuant to Company instructions
Agere Systems Inc.
6 Software Architecture
(continued)
6.2 Registers
(continued)
6.2.3 Register Encodings
(continued)
Table 144. cloop (Cache Loop) Register
Table 145. csave (Cache Save) Register
Table 146. cstate (Cache State) Register
15—0
Cache Loop Count
Bit
15—0 Cache Loop Count Contains the count for the number of loop iterations for a
do K
,
redo K
,
do
cloop
, or
redo cloop
instruction. The core decrements
cloop
after every
loop iteration and
cloop
contains zero after the loop has completed.
Field
Description
R/W Reset Value
R/W
0
31—0
Cache Save
Bit
31—0
Field
Description
R/W Reset Value
R/W
For this column, X indicates unknown on powerup reset and unaffected on subsequent reset.
Cache Save
Contains the opcode of the instruction following a
do K
,
redo K
,
do cloop
, or
redo cloop
instruction.
X
15
SU
14
EX
13
LD
12—10
Reserved
9—5
4—0
N[4:0]
PTR[4:0]
Bit
Field
Value
Description
R/W
Reset
Value
0
15
SU
0
The cache is not suspended—the core is not executing an interrupt or trap
service routine that has interrupted or trapped a cache loop.
The cache is suspended—the core is executing an interrupt or trap service
routine that has interrupted or trapped a cache loop.
The core is not executing from cache—it is either loading the cache (exe-
cuting iteration 1 of a cache loop) or it is not executing a cache loop.
The core is executing from cache—it is executing iteration 2 or higher of a
cache loop.
The core is not loading the cache—it is either not executing a cache loop or
it is executing iteration 2 or higher of a cache loop.
The core is loading the cache—it is executing iteration 1 of a cache loop.
Reserved—write with zero.
Pointer to current instruction in cache to load or execute.
Number of instructions in the cache loop to load/save/restore.
R/W
1
14
EX
0
R/W
0
1
13
LD
0
R/W
0
1
0
12—10
9—5
4—0
Reserved
PTR[4:0]
N[4:0]
R/W
R/W
R/W
0
0
0
0—30
0—31
After execution of the first
do K
or
do cloop
instruction, N[4:0] contains a nonzero value.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| DSP16410 | 16-bit fixed point DSP with Flash |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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