參數(shù)資料
型號: DSP16410C
英文描述: TVS 400W 7.0V UNIDIRECT SMA
中文描述: DSP1629數(shù)字信號處理器
文件頁數(shù): 309/373頁
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代理商: DSP16410C
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Data Sheet
June 2001
DSP16410B Digital Signal Processor
Agere Systems Inc.
Agere Systems—Proprietary
Use pursuant to Company instructions
253
7 Ball Grid Array Information
(continued)
7.2 256-Ball EBGA Package
Figure 61
illustrates the ball assignment for the 256-ball EBGA package. This view is from the top of the package.
Figure 61. 256-Ball EBGA Package Ball Grid Array Assignments (See-Through Top View)
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
A
VSS
VDD2
EION
ERWN1
VSS
VSS
VDD2
ED27
ED25
ED23
VDD2
VSS
VSS
ED15
VDD2
VSS
ED9
ED5
VDD2
VSS
A
B
VDD2
VSS
EA2
ERAMN ERWN0
ED30
NC
ED28
ED26
ED22
ED20
ED18
ED17
ED14
NC
ED11
ED7
VDD1
VSS
VDD2
B
C
EA4
EA3
VSS
EA1
VDD1
EACKN
VDD1
ED29
VDD1
VDD1
ED21
ED19
ED16
ED13
ED12
ED8
NC
VSS
ED4
ED1
C
D
EA8
EA6
VDD1
NC
EA0
EROMN
ED31
VDD2
VDD1
ED24
VDD2
VDD1
VDD1
VDD2
ED10
ED6
NC
ED3
ED0
EREQN
D
E
VSS
EA10
EA7
EA5
ED2
VDD1
ESIZE
VSS
E
F
VDD2
NC
EA11
EA9
ERDY
EXM
TDO0
VSS
F
G
VDD1
EA13
EA12
VDD2
ERTYPE
VDD1
NC
VDD2
G
H
VSS
EA16
EA15
EA14
VDD2
TRST0N
TCK0
TMS0
H
J
VSS
VDD1
EA18
EA17
TDI0
VDD1A
CKI
VSS1A
J
K
VDD2
ESEG0
NC
VDD2
RSTN
INT3
VDD1
TRAP
K
L
ESEG2
ESEG1
VDD1
ESEG3
VDD2
INT2
INT1
VDD2
L
M
ECKO
TDI1
VDD1
VDD1
SICK0
INT0
SIFS0
VSS
M
N
TMS1
TCK1
TRST1N
VDD2
SOFS0
SOCK0
VDD1
VSS
N
P
VDD2
NC
VDD1
SOD1
VDD2
SOD0
SID0
SCK0
P
R
VSS
TDO1
SID1
SOCK1
IO0BIT4 IO0BIT6
NC
VDD2
R
T
VSS
SCK1
VDD1
IO1BIT0
VDD1
IO0BIT2 IO0BIT5
VSS
T
U
SOFS1
SIFS1
IO1BIT1
NC
IO1BIT4 PADD1
VDD2
VDD1
VDD1
VDD2
PD2
VDD1
VDD2
PD9
PD13
EYMODE
NC
NC
IO0BIT1 IO0BIT3
U
V
SICK1
IO1BIT2
VSS
NC
IO1BIT6 PADD3
PCSN
PODS
PRDY
POBE
VDD1
VDD1
PD7
VDD1
PD10
VDD1
VSS
VSS
NC
NC
V
W
VDD2
VSS
VDD1
IO1BIT5 PADD2
NC
PRWN PRDYMD
PINT
PIBF
PD0
PD4
PD6
NC
PD8
PD11
PD14
IO0BIT0
VSS
VDD2
W
Y
VSS
VDD2
IO1BIT3 PADD0
VSS
VDD2
PIDS
VSS
VSS
VDD2
PD1
PD3
PD5
VDD2
VSS
VSS
PD12
PD15
VDD2
VSS
Y
1
2
3
4
5
6
7
8
9
10
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13
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