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參數(shù)資料
| 型號： | DSP16410C |
| 英文描述： | TVS 400W 7.0V UNIDIRECT SMA |
| 中文描述： | DSP1629數(shù)字信號處理器 |
| 文件頁數(shù)： | 175/373頁 |
| 文件大小： | 5643K |
| 代理商： | DSP16410C |
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Data Sheet
June 2001
DSP16410B Digital Signal Processor
Agere Systems Inc.
Agere Systems—Proprietary
Use pursuant to Company instructions
119
4 Hardware Architecture
(continued)
4.14 System and External Memory Interface (SEMI)
(continued)
4.14.5 Asynchronous Memory
(continued)
4.14.5.3 Interfacing Examples
Figures
32
and
33
illustrate two examples of interfacing 16-bit asynchronous SRAMs to the SEMI. The user can
individually configure the EROMN, ERAMN, and EION enables to support asynchronous devices. The ERTYPE
pin must be at logic low for the EROM component to be configured for asynchronous accesses. Clearing the
YTYPE field (
ECON1
[9]) and ITYPE field (
ECON1
[10]) configures the ERAM and EIO components for asynchro-
nous accesses.
The programmer can individually configure the access time (defined as the number of CLK cycles that the enable is
asserted) for each enable. The YATIME field (
ECON0
[7:4]) specifies the number of CLK cycles that the ERAMN
enable is asserted. The XATIME field (
ECON0
[3:0]) specifies the number of CLK cycles that the EROMN enable is
asserted. The IATIME field (
ECON0
[11:8]) specifies the number of CLK cycles that the EION enable is asserted.
The range of values for these fields is from 0 to 15 (corresponding to a range of 1 to 15 CLK cycles). A value of 0
or 1 programs a 1 CLK assertion time for the corresponding enable.
相關PDF資料 |
PDF描述 |
|---|---|
| DSP16410 | 16-bit fixed point DSP with Flash |
| DSP25-16AR | Phase-leg Rectifier Diode |
| DSP25 | Phase-leg Rectifier Diode |
| DSP25-12A | Phase-leg Rectifier Diode |
| DSP25-12AT | Phase-leg Rectifier Diode |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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| DSP1643 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Telecommunication IC |
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| DSP1675TV2RDD12VDB | 制造商:Agere Systems 功能描述: |
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