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參數(shù)資料
| 型號(hào)： | DSP16410C |
| 英文描述： | TVS 400W 7.0V UNIDIRECT SMA |
| 中文描述： | DSP1629數(shù)字信號(hào)處理器 |
| 文件頁(yè)數(shù)： | 238/373頁(yè) |
| 文件大?。?/td> | 5643K |
| 代理商： | DSP16410C |
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Data Sheet
June 2001
DSP16410B Digital Signal Processor
182
Agere Systems—Proprietary
Use pursuant to Company instructions
Agere Systems Inc.
4 Hardware Architecture
(continued)
4.16 Serial Interface Unit (SIU)
(continued)
4.16.15 Registers
(continued)
Table 101. SCON0 (SIU Input/Output General Control) Register
The memory address for this register is 0x43000 for SIU0 and 0x44000 for SIU1.
15—13
12—11
10
Reserved
OSIZE[1:0]
OMSB
9—8
7—5
4—3
2
1—0
OFORMAT[1:0]
Reserved
ISIZE[1:0]
IMSB
IFORMAT[1:0]
Bit
Field
Reserved
OSIZE[1:0]
Value
0
0
1
2
3
0
1
00
Description
R/W Reset Value
R/W
R/W
15—13
12—11
Reserved—write with zero.
The channel size for serial output data is 8 bits
.
The channel size for serial output data is 16 bits.
The channel size for serial output data is 4 bits
.
The channel size for serial output data is 12 bits
.
Shift data out onto SOD pin least significant bit (LSB) first.
Shift data out onto SOD pin most significant bit (MSB) first.
When transferring data from the
SODR
register to the output shift regis-
ter, do not format (modify) the data.
Reserved.
When transferring 16-bit data from the
SODR
register to the output shift
register, convert the most significant 14 bits of
SODR
(
SODR
[15:2]) from
linear PCM format to 8-bit μ-law PCM format, place the result into the
lower half of the output shift register, and clear the upper half. Ignore the
least significant 2 bits of
SODR
.
When transferring 16-bit data from the
SODR
register to the output shift
register, convert the most significant 13 bits of
SODR
(
SODR
[15:3]) from
linear PCM format to 8-bit A-law PCM format, place the result into the
lower half of the output shift register, and clear the upper half. Ignore the
least significant 3 bits of
SODR
.
Reserved—write with zero.
The channel size for serial input data is 8 bits
.
The channel size for serial input data is 16 bits.
The channel size for serial input data is 4 bits
.
The channel size for serial input data is 12 bits
.
Capture input data from SID pin least significant bit (LSB) first.
Capture input data from SID pin most significant bit (MSB) first.
When transferring 16-bit data from the
SIB
register to the
SIDR
register,
do not format (modify) the data.
Reserved.
When transferring data from the
SIB
register to the
SIDR
register, con-
vert the lower 8 bits of
SIB
(
SIB
[7:0]) from μ-law PCM format to 14-bit lin-
ear PCM format, place the result into the 14 most significant bits of
SIDR
(
SIDR
[15:2]), and clear the least significant 2 bits of
SIDR
(
SIDR
[1:0]).
When transferring data from the
SIB
register to the
SIDR
register, con-
vert the lower 8 bits of
SIB
(
SIB
[7:0]) from A-law PCM format to 13-bit lin-
ear PCM format, place the result into the 13 most significant bits of
SIDR
(
SIDR
[15:3]), and clear the least significant 3 bits of
SIDR
(
SIDR
[2:0]).
0
0
10
OMSB
R/W
0
9—8
OFORMAT[1:0]
R/W
00
01
10
11
7—5
4—3
Reserved
ISIZE[1:0]
§
0
0
1
2
3
0
1
00
R/W
R/W
0
0
2
IMSB
§
R/W
0
1—0
IFORMAT[1:0]
§
R/W
00
01
10
11
§
The SIU right justifies the received serial input data, i.e., it places the data in the least significant bit positions of the 16-bit serial input buffer
register and fills the upper bits with zeros.
The
SIB
register is an intermediate register that holds the contents of the input shift register and is not user accessible.
If the ORESET field (
SCON2
[10]) is cleared, do not change the value in this field.
The SIU shifts data from the low portion of the output shift register onto the SOD pin and ignores the high portion of the register.
If the IRESET field (
SCON1
[10]) is cleared, do not change the value in this field.
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