- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄376460 > XRT7245 (Exar Corporation) DS3 ATM User Network Interface(DS3異步傳輸模式用戶網(wǎng)絡(luò)接口) PDF資料下載
參數(shù)資料
| 型號(hào)： | XRT7245 |
| 廠商： | Exar Corporation |
| 英文描述： | DS3 ATM User Network Interface(DS3異步傳輸模式用戶網(wǎng)絡(luò)接口) |
| 中文描述： | DS3自動(dòng)柜員機(jī)用戶網(wǎng)絡(luò)接口（DS3異步傳輸模式用戶網(wǎng)絡(luò)接口） |
| 文件頁數(shù)： | 97/324頁 |
| 文件大小： | 4103K |
| 代理商： | XRT7245 |
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á
PRELIMINARY
DS3 UNI FOR ATM
XRT7245
REV. 1.03
97
Receive Cell Processor, upon identifying an incoming
OAM cell, will copy the header and payload contents
of this cell to the “Received OAM Cell” buffer (in on-
chip RAM). If the user does not configure the Receive
Cell processor to perform an “OAM Cell Check”, the
OAM cell will simply be treated like any other user
cell, as it is processed through the User Cell Filter,
where it can be discarded or written to the Rx FIFO.
Writing a “0” to this bit-field disables the OAM Cell
Check feature. Writing a “1” to this bit-field enables
this feature.
Bit 2–De-Scramble Enable
This “Read/Write” bit-field allows the user to enable
or disable the Cell Descrambler, within the Receive
Cell Processor. When the Cell Descrambler is en-
abled, the Receive Cell Processor will “presume” that
the payload portion of each incoming cell has been
scrambled by the “far-end” Transmit Cell Processor.
Therefore, the Receive Cell Processor will modify the
contents of the cell payload accordingly. If the Cell
Descrambler is disabled, then the Receive Cell Pro-
cessor will perform NO modifications to the payload,
of the incoming cells, at all.
Writing a “0” to this bit-field disables the Cell De-
Scrambler. Writing a “1” to this bit-field enables the
Cell Descrambler.
For more information on Cell Scrambling and Cell
Descrambling, please see Sections 6.2.2.2 and
7.3.2.5.
Bit 1—Rx Coset Enable
This “Read/Write” bit-field allows the user to config-
ure the Receive Cell Processor to account for (or not
to account for) the “far-end” Transmit Cell Processor’s
modulo-2 addition of the Coset polynomial: x
6
+ x
4
+
x
2
+ 1 to the “original” HEC byte, during HEC byte cal-
culation and insertion.
If the user configures the Receive Cell Processor to
account for the Coset Polynomial, then the Receive
Cell Processor will go through the following procedure
during HEC byte verification:
Recompute the “Original” HEC (CRC-8) byte,
based upon the values of bytes 1 through 4 in the
received cell.
Modulo-2 add the Coset Polynomial to the CRC-8
byte, thereby creating the “HEC byte”.
Compare the locally computed HEC byte with the
fifth octet of the incoming cell.
If the user configures the Receive Cell Processor to
NOT account for the Coset Polynomial, then the
Receive Cell Processor will go through the following
procedure during HEC byte verification:
Recompute the HEC byte, based upon the values
of bytes 1 through 4 in the received cell.
Compare the locally computed HEC byte with the
fifth octet of the incoming cell.
Writing a “0” to this bit-field configures the Receive Cell
Processor to NOT account for the Coset Polynomial.
Writing a “1” to this bit-field configures the Receive
Cell Processor to account for the Coset Polynomial.
Bit 0—HEC Error Ignore
This “Read/Write” bit-field allows the user to config-
ure the Receive Cell Processor to either discard or
retain cells with HEC errors.
If the user configures the Receive Cell Processor to
discard these errored cells (the default condition),
then all incoming cells containing single-bit (when the
Receive Cell Processor is operating in the “Detection
Mode”) or multi-bit errors in their header, will be dis-
carded and will NOT be written to the Rx FIFO.
Note:
If the Receive Cell Processor is operating in the
“Correction Mode”, then those cells that contain single-bit
errors will be corrected, via the HEC Byte Verification
Algorithm, and will not be discarded).
If the user configures the Receive Cell Processor to
retain these errored cells, then all incoming cells con-
taining single-bit or multi-bit errors in their headers, will
NOT be discarded, and may (depending upon the Idle
or User cell filter settings) be written to the Rx FIFO.
Writing a “0” to this bit-field disables this feature (e.g.,
Receive Cell Processor will discard errored cells).
Writing a “1” to this bit-field enable this feature (e.g.,
Receive Cell Processor will retain errored cells.)
Note:
For more information on this feature, please see
Section 7.3.2.2.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT7288IP | CEPT1 Line Interface |
| XRT7288 | CEPT1 Line Interface(CEPT1線接口) |
| XRT7288IW | CEPT1 Line Interface |
| XRT7295AE | E3 (34.368Mbps) Integrated line Receiver |
| XRT7295AE_03 | E3 (34.368Mbps) Integrated line Receiver |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XRT7250 | 制造商:EXAR 制造商全稱:EXAR 功能描述:DS3/E3 FRAMER IC |
| XRT7250ES-PCI | 功能描述:界面開發(fā)工具 Evaluation Board for XRT7250 Series RoHS:否 制造商:Bourns 產(chǎn)品:Evaluation Boards 類型:RS-485 工具用于評(píng)估:ADM3485E 接口類型:RS-485 工作電源電壓:3.3 V |
| XRT7250IQ100 | 制造商:EXAR 制造商全稱:EXAR 功能描述:DS3/E3 FRAMER IC |
| XRT7288 | 制造商:EXAR 制造商全稱:EXAR 功能描述:CEPT1 Line Interface |
| XR-T7288 | 制造商:EXAR 制造商全稱:EXAR 功能描述:CEPT1 Line Interface |
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