- 您現(xiàn)在的位置：買(mǎi)賣(mài)IC網(wǎng) > PDF目錄376460 > XRT7245 (Exar Corporation) DS3 ATM User Network Interface(DS3異步傳輸模式用戶網(wǎng)絡(luò)接口) PDF資料下載
參數(shù)資料
| 型號(hào)： | XRT7245 |
| 廠商： | Exar Corporation |
| 英文描述： | DS3 ATM User Network Interface(DS3異步傳輸模式用戶網(wǎng)絡(luò)接口) |
| 中文描述： | DS3自動(dòng)柜員機(jī)用戶網(wǎng)絡(luò)接口（DS3異步傳輸模式用戶網(wǎng)絡(luò)接口） |
| 文件頁(yè)數(shù)： | 168/324頁(yè) |
| 文件大?。?/td> | 4103K |
| 代理商： | XRT7245 |
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XRT7245
DS3 UNI FOR ATM
á
PRELIMINARY
REV. 1.03
168
Upon power up or reset, the “HEC Byte Calculator
and Insertion” feature is enabled. The user must
write a “0” to this bit in order to disable this operation.
6.2.2.1.2
Configuring the “HEC Byte Calculator
and Insertion” Feature for Idle Cells
The user can separately enable or disable the “HEC
Byte Calculation and Insertion” feature for the outbound
Idle Cells. The user can exercise this option by writ-
ing the appropriate value to bit 1 (Idle Cell HEC
CalEn) within the TxCP Control Register, as depicted
below.
This “Read/Write” bit-field allows the user to enable
and disable the “Calculation and Insertion” of the
HEC byte into the Idle Cell as illustrated below. If the
user chooses to disable this feature, then the 5th oc-
tet of the Idle Cells will be transmitted to the Transmit
PLCP (or Transmit DS3 Framer) block as pro-
grammed in the “Tx CP Idle Cell Pattern Header—
Byte 5” register (Address = 68h).
Upon power up or reset, the Transmit Cell Processor
will be configured such that the HEC bytes will be
calculated and inserted into the fifth octet position of
each Idle Cell. The user must write a “0” to this bit-
field in order to disable this feature.
6.2.2.1.3
Modulo-2 Addition of Coset
Polynomial to the HEC Byte Value
When enabled, the HEC Byte Calculator takes the
first four bytes of each cell and computes a CRC-8
value via the generating polynomial x
8
+ x
2
+ x + 1.
The BISDN Physical Layer specifications (ITU
Recommendations I.432) specifies that this CRC-8 (or
HEC) value can optionally be modulo-2 added to the
polynomial x
6
+ x
4
+ x
2
+ 1; and inserting the result of
this calculation into the fifth byte of each cell. The pur-
pose of this option is to provide protection against bit
slips. This protection is not required in transmission
systems that ensure adequate one’s density. Howev-
er, this operation does provide protection against all ze-
ros cells that could be passed to the ATM Layer during
a loss of signal condition on the transmission medium.
The ATM Forum UNI specifications also requires this
operation.
T
ABLE
16: T
HE
R
ELATIONSHIP
BETWEEN
THE
CONTENTS
OF
B
IT
-
FIELD
5 (HEC I
NSERT
E
NABLE
)
WITHIN
THE
T
X
CP
C
ONTROL
R
EGISTER
,
AND
THE
HEC B
YTE
C
ALCULATOR
’
S
HANDLING
OF
VALID
CELLS
HEC I
NSERT
E
NABLE
R
ESULT
0
HEC Byte Calculation is disabled and the 5th byte is transmitted to the Transmit PLCP Block
(or Transmit DS3 Framer) as is
1
The HEC Byte is calculated and is inserted into the 5th octet position of each valid cell.
TxCP Control Register (Address = 60h)
B
IT
7
B
IT
6
B
IT
5
B
IT
4
B
IT
3
B
IT
2
B
IT
1
B
IT
0
Scrambler
En
Coset
Enable
HEC Insert
Enable
TDPChk
Pattern
GFC Insert
Enable
TDPErr
Interrupt
Enable
Idle Cell
HEC
CalEn
TDPErr
Interrupt
Status
R/W
R/W
R/W
R/W
R/W
R/W
R/W
RUR
1
1
1
1
0
0
x
0
T
ABLE
17: T
HE
R
ELATIONSHIP
BETWEEN
THE
CONTENTS
WITHIN
B
IT
1 (IC HEC C
ALC
E
N
)
OF
THE
“T
X
CP C
ONTROL
R
EGISTER
”
AND
THE
RESULTING
HANDLING
OF
I
DLE
C
ELLS
,
BY
THE
“HEC B
YTE
C
ALCULATOR
”
IC HEC C
ALC
E
N
R
ESULT
0
The entire programmed Idle Cell header is transmitted without Modification
1
The HEC byte is calculated, via the first four bytes of the header, and is inserted into the fifth octet
position within each Idle Cell.
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