- 您現(xiàn)在的位置：買(mǎi)賣(mài)IC網(wǎng) > PDF目錄376460 > XRT7245 (Exar Corporation) DS3 ATM User Network Interface(DS3異步傳輸模式用戶網(wǎng)絡(luò)接口) PDF資料下載
參數(shù)資料
| 型號(hào)： | XRT7245 |
| 廠商： | Exar Corporation |
| 英文描述： | DS3 ATM User Network Interface(DS3異步傳輸模式用戶網(wǎng)絡(luò)接口) |
| 中文描述： | DS3自動(dòng)柜員機(jī)用戶網(wǎng)絡(luò)接口（DS3異步傳輸模式用戶網(wǎng)絡(luò)接口） |
| 文件頁(yè)數(shù)： | 112/324頁(yè) |
| 文件大?。?/td> | 4103K |
| 代理商： | XRT7245 |
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XRT7245
DS3 UNI FOR ATM
á
PRELIMINARY
REV. 1.03
112
Writing a “0” to this bit-field disables this interrupt.
Writing a “1” to this bit-field enables this interrupt.
Bit 3—RxFIFO Change of Cell Alignment Interrupt
Enable
This “Read/Write” bit-field allows the user to enable
or disable the “Rx FIFO Change of Cell Alignment”
interrupt.
Writing a “0” to this bit-field disables this interrupt.
Writing a “1” to this bit-field enables this interrupt.
Bit 2—RxFIFO Overrun Interrupt Status
This “Read-Only” bit-field indicates whether or not the
“Rx FIFO Overrun Condition” interrupt has occurred
since the last read of this register.
A “0” in this bit-field indicates that the “Rx FIFO Over-
run Condition” interrupt has not occurred since the
last read of this register.
A “1” in this bit-field indicates that the “Rx FIFO Over-
run Condition” interrupt has occurred since the last
read of this register.
For more information on this interrupt condition,
please see Section 7.4.2.3.2
Bit 1—RxFIFO Underrun Interrupt Status
This “Read-Only” bit-field indicates whether or not
the “Rx FIFO Underrun Condition” interrupt has
occurred since the last read of this register.
A “0” in this bit-field indicates that the “Rx FIFO
Underrun Condition” interrupt has not occurred since
the last read of this register.
A “1” in this bit-field indicates that the “Rx FIFO
Underrun Condition” interrupt has occurred (e.g., the
RxFIFO has been depleted of cell data ) since the
last read of this register.
For more information on this interrupt condition,
please see Section 7.4.2.3.3.
Bit 0—RxFIFO Change of Cell Alignment Interrupt
Status
This “Read-Only” bit-field indicates whether or not
the “Rx FIFO Change of Cell Alignment” interrupt has
occurred since the last read of this register.
A “0” in this bit-field indicates that the “Rx FIFO
Change of Cell Alignment” interrupt has not occurred
since the last read of this register.
A “1” in this bit-field indicates that the “Rx FIFO
Change of Cell Alignment” interrupt has occurred
since the last read of the register.
For more information on this interrupt condition,
please see Section 7.4.2.3.1.
3.3.2.108
Receive UTOPIA Address Register
Bits 4 through 0 of this register are “Read/Write” bit-
fields that allows the user to assign a specific “UTOPIA
Address” value to this Receive UTOPIA Interface
block. This register is only important when the UNI is
running in Multi-PHY operation. For more information
on this register and the Receive UTOPIA Address bus,
please see Section 7.4.2.2.2.2.
3.3.2.109
Receive UTOPIA FIFO Status Register
Address = 6Ch, Receive UTOPIA Address Register
B
IT
7
B
IT
6
B
IT
5
B
IT
4
B
IT
3
B
IT
2
B
IT
1
B
IT
0
Unused
Receive UTOPIA Address
RO
RO
RO
R/W
R/W
R/W
R/W
R/W
0
0
0
0
0
0
0
0
Address = 6Dh, Receive UTOPIA FIFO Status Register
B
IT
7
B
IT
6
B
IT
5
B
IT
4
B
IT
3
B
IT
2
B
IT
1
B
IT
0
Unused
RxFIFO Full
RxFIFO Empty
RO
RO
RO
RO
RO
RO
RO
RO
0
0
0
0
0
0
0
1
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT7288IP | CEPT1 Line Interface |
| XRT7288 | CEPT1 Line Interface(CEPT1線接口) |
| XRT7288IW | CEPT1 Line Interface |
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| XRT7295AE_03 | E3 (34.368Mbps) Integrated line Receiver |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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