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參數(shù)資料
| 型號： | XRT7245 |
| 廠商： | Exar Corporation |
| 英文描述： | DS3 ATM User Network Interface(DS3異步傳輸模式用戶網(wǎng)絡接口) |
| 中文描述： | DS3自動柜員機用戶網(wǎng)絡接口（DS3異步傳輸模式用戶網(wǎng)絡接口） |
| 文件頁數(shù)： | 150/324頁 |
| 文件大?。?/td> | 4103K |
| 代理商： | XRT7245 |
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XRT7245
DS3 UNI FOR ATM
á
PRELIMINARY
REV. 1.03
150
Note:
regarding Figure 33
The Transmit UTOPIA Data Bus is configured to
be 16 bits wide. Hence, the data which the ATM
Layer processor places on the Transmit UTOPIA
Data Bus is expressed in terms of 16-bit words:
(e.g., W0–W26).
The Transmit UTOPIA Interface block is config-
ured to handle 54 bytes/cell. Hence, Figure 33
illustrates the ATM Layer processor writing 27
words (W0 through W26) for each ATM cell.
1.
2.
In Figure 33, TxClav is initially “high” during clock
edge # 1. However, shortly after the ATM Layer pro-
cessor writes in word W20, TxClav toggles “l(fā)ow”,
indicating that the TxFIFO is starting to fill up. The
ATM Layer processor will detect this “negation of
TxClav” during clock edge #2; while it is writing word
W21 into the Transmit UTOPIA Interface block. At this
point, the ATM Layer processor is only permitted to
execute four more “write” operations with the Trans-
mit UTOPIA Interface block. Therefore, the ATM
Layer processor will proceed to write in words: W22,
W23, W24 and W25 before negating TxEnB*. The
ATM Layer processor must keep TxEnB* negated
until it detects that TxClav has once again returned
“high”. In Figure 33, TxClav is asserted after clock
edge #8. The ATM Layer processor detects this tran-
sition in TxClav at clock edge #9; and subsequently,
asserts TxEnB*. The ATM Layer resumes writing in
more ATM cell data into the Transmit UTOPIA
Interface block.
6.1.2.3.0.2
The UNI will be operating in the “Cell-Level” Hand-
shaking mode following power up or reset. In the
“Cell-Level” Handshaking mode, when the TxClav is
at a logic “1”, it means that the Tx FIFO has enough
remaining empty space for it to receive at least one
more full cell of data from the ATM Layer processor.
However, when TxClav toggles from “high” to “l(fā)ow”, it
indicates that the very next cell (following the one that
is currently being written) cannot be accepted by the
Tx FIFO. Conversely, once TxClav has returned to
the logic “1” level, it indicates that at least one more
full cell may be written into the Tx FIFO by the ATM
Layer processor. As in the “Octet-Level” Handshake
mode, the ATM Layer processor is expected to poll
the TxClav output towards the end of transmission of
the cell currently being written and to proceed with
transmission of the next cell only if TxClav is at a log-
ic “high”.
The UNI can operate in either the “Octet-Level” or the
“Cell-Level” Handshake mode, when operating in the
Single-PHY mode. However, only the “Cell-Level”
Handshake Mode is available when the UNI is oper-
ating in the Multi-PHY mode. For more information on
Single PHY and Multi PHY operation, please see
Section 6.1.2.3.
The user can configure the UNI to operate in one of
these two handshake modes by writing the appropriate
data to Bit 5 (Handshake Mode) within the UTOPIA
Configuration Register, as depicted below.
Cell-Level Handshaking
F
IGURE
33. T
IMING
D
IAGRAM
OF
T
X
C
LAV
/T
X
F
ULL
B
AND
VARIOUS
OTHER
SIGNALS
DURING
WRITES
TO
THE
T
RANSMIT
UTOPIA,
WHILE
OPERATING
IN
THE
O
CTET
-L
EVEL
H
ANDSHAKING
M
ODE
.
TxClk
TxClav
TxEnB*
TxData[15:0]
TxSoC
X
X
X
W26
W0
W1
W25
W24
W23
W22
W21
W20
1
2
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相關PDF資料 |
PDF描述 |
|---|---|
| XRT7288IP | CEPT1 Line Interface |
| XRT7288 | CEPT1 Line Interface(CEPT1線接口) |
| XRT7288IW | CEPT1 Line Interface |
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| XRT7295AE_03 | E3 (34.368Mbps) Integrated line Receiver |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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