- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄376460 > XRT7245 (Exar Corporation) DS3 ATM User Network Interface(DS3異步傳輸模式用戶網(wǎng)絡(luò)接口) PDF資料下載
參數(shù)資料
| 型號： | XRT7245 |
| 廠商： | Exar Corporation |
| 英文描述： | DS3 ATM User Network Interface(DS3異步傳輸模式用戶網(wǎng)絡(luò)接口) |
| 中文描述： | DS3自動柜員機用戶網(wǎng)絡(luò)接口（DS3異步傳輸模式用戶網(wǎng)絡(luò)接口） |
| 文件頁數(shù)： | 248/324頁 |
| 文件大小： | 4103K |
| 代理商： | XRT7245 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁當(dāng)前第248頁第249頁第250頁第251頁第252頁第253頁第254頁第255頁第256頁第257頁第258頁第259頁第260頁第261頁第262頁第263頁第264頁第265頁第266頁第267頁第268頁第269頁第270頁第271頁第272頁第273頁第274頁第275頁第276頁第277頁第278頁第279頁第280頁第281頁第282頁第283頁第284頁第285頁第286頁第287頁第288頁第289頁第290頁第291頁第292頁第293頁第294頁第295頁第296頁第297頁第298頁第299頁第300頁第301頁第302頁第303頁第304頁第305頁第306頁第307頁第308頁第309頁第310頁第311頁第312頁第313頁第314頁第315頁第316頁第317頁第318頁第319頁第320頁第321頁第322頁第323頁第324頁
XRT7245
DS3 UNI FOR ATM
á
PRELIMINARY
REV. 1.03
248
Bit 0—“PLOF Interrupt Status
A “1” in this bit-field indicates that the Receive PLCP
Processor has requested a “Change of PLOF” interrupt.
Note, this type of interrupt could occur due to a transi-
tion in the framing state from the “Out-of-Frame”
state to the “Un-framed” state; during which the
RxLOF pin will toggle “high”. This type of interrupt
could also occur due to a transition from the
“Un-framed” state to the “In-frame” state. It is possible
to distinguish between these two possibilities based
upon the read-in content of the Rx PLCP Configuration/
Status register. If the local μC/μP reads in a
‘xxxxx00xb” value from this register, then the “Change
in PLOF” interrupt request was due to a transition
from the “Un-framed” to the “In-frame” condition.
Conversely, if the local
μ
C/
μ
P reads in the value
“xxxxx11xb” then the “Change in PLOF” interrupt
request was due to a transition from the “Out-of-
Frame” state to the “Un-framed” state.
Bit 1—POOF Interrupt Status
A “1” in this bit-field indicates that the Receive PLCP
Processor has requested a “Change of OOF status”
interrupt. Note, this type of interrupt request could
occur due to a transition from the “Un-framed” state
to the “In-frame” state;’ during which the RxOOF pin
will toggle “l(fā)ow”. This type of interrupt could also occur
due to a transition from the “In-frame” to the “Out-of-
Frame” state. It is possible to distinguish between
these two possibilities based upon the read-in content
of the Rx PLCP Configuration/Status register. If the
local μC/μP reads in a “xxxxx0xxb” value from this
register, then the Receive PLCP Processor has tran-
sitioned from the “Un-framed” state to the “In-frame”
state. Conversely, if the local μC/μP reads in
“xxxxx1xxb”, then this indicates the transition from
the “In-frame” state to the “Out-of Frame” state.
The user can enable/disable each of these interrupts
by writing the appropriate data to the Receive PLCP
Interrupt Enable Register. This register has the exact
same bit-format as does the Receive PLCP Interrupt
Status Register. However, the bit-format of this register
is presented below for the sake of completeness.
The user can enable these interrupts by writing a “1”
to their corresponding bit-fields, in this register.
Conversely, the user can disable these interrupts by
writing a “0” to these bit fields. These bit-fields are “0”
upon power-up or reset of the UNI chip.
7.3
Receive Cell Processor
7.3.1
Brief Description of the Receive Cell
Processor
The Receive Cell Processor receives either delineated
PLCP frames from the Receive PLCP Processor, or
“Direct Mapped ATM” cells from the Receive DS3
Framer. The Receive Cell Processor will then perform
the following operations on this data.
Cell Delineation
HEC Byte Verification
Idle Cell Filtering (optional)
User/OAM Cell Filtering (optional)
Cell-payload de-scrambling (optional)
The Receive Cell Processor will also output the GFC
Nibble value of each incoming cell, via the “Receive
GFC Nibble Field” Serial Output port.
Figure 76 presents a simple block diagram of the Re-
ceive Cell Processor block along with its external pins.
B
IT
7
B
IT
6
B
IT
5
B
IT
4
B
IT
3
B
IT
2
B
IT
1
B
IT
0
Unused
POOF Interrupt
Enable
PLOF Interrupt
Enable
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
x
x
x
x
x
x
0
0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| XRT7288 | CEPT1 Line Interface(CEPT1線接口) |
| XRT7288IW | CEPT1 Line Interface |
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| XRT7295AE_03 | E3 (34.368Mbps) Integrated line Receiver |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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