- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄376460 > XRT7245 (Exar Corporation) DS3 ATM User Network Interface(DS3異步傳輸模式用戶網(wǎng)絡(luò)接口) PDF資料下載
參數(shù)資料
| 型號(hào)： | XRT7245 |
| 廠商： | Exar Corporation |
| 英文描述： | DS3 ATM User Network Interface(DS3異步傳輸模式用戶網(wǎng)絡(luò)接口) |
| 中文描述： | DS3自動(dòng)柜員機(jī)用戶網(wǎng)絡(luò)接口（DS3異步傳輸模式用戶網(wǎng)絡(luò)接口） |
| 文件頁(yè)數(shù)： | 166/324頁(yè) |
| 文件大?。?/td> | 4103K |
| 代理商： | XRT7245 |
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XRT7245
DS3 UNI FOR ATM
á
PRELIMINARY
REV. 1.03
166
6.2.2
Functional Description of Transmit
Cell Processor
The Transmit Cell Processor consists of the following
functional blocks.
Configuration and Status Register
Controller
HEC Byte Calculator
OAM Cell Processor
Cell Scrambler
IDLE Cell Generator
“Transmit GFC Nibble-field” serial input port
Most of these functional blocks will be discussed in
some detail below. The Transmit Cell Processor will
read in ATM Cell Data from the Tx FIFO. The first four
bytes of each cell is loaded into the “HEC Byte calcu-
lator”. The fifth byte of each cell will be read-in and
compared against a pre-defined “Data Path Integrity
Check” pattern. While this “check” is being performed;
the “HEC Byte Calculator” will take these first four
bytes of the cell, and compute a HEC byte value. This
HEC byte value will be written (or inserted) into the
5th octet position of the cell. Consequently, the “Data
Path Integrity Check” pattern will now be overwritten.
Bytes 6 through 53 (the cell payload) of each cell, are
sent onto the “Cell Scrambler” and are summarily
“scrambled”. Afterwards, the cell is reassembled
(with the first four header bytes, the newly computed
HEC byte and scrambled payload), and is routed to
the Transmit PLCP Processor or Transmit DS3 Framer.
When a complete cell is not available in the TxFIFO, a
cell is created by the “Idle Cell Generator”. The user
has the option of specifying the contents of the header
and payload of these Idle Cells via the μP-accessible
registers. The payload of the Idle Cell will be pro-
grammed with a repeating pattern of a byte contained
within an on-chip register. From this point on, the Idle
Cell is processed in the same manner as is an as-
signed (e.g., user or OAM) cell. A valid HEC byte is
F
IGURE
44. F
UNCTIONAL
B
LOCK
D
IAGRAM
OF
THE
T
RANSMIT
C
ELL
P
ROCESSOR
B
LOCK
DataBusL[7:0]
DataBusH[7:0]
ReadB
WriteB
CSB
Configuration
and Status
Registers
TUSoC
TCelPresent
TFDat
CellOf52
TxGFC
TxGFCClk
TxGFCMSB
SendOAM
TDPChkPat
ICHECCalcEn
HECInsEn
HECErrMask
OAMSent
TDPIntegFail
Controller
CosetIn
GFCInsEn
ICGRegSel[5:0]
HEC
Calculator
HECEn
FIFOrlCDAT[7:0]
GFC[3:0]
HECSoC
TICCount
TCellCount
TxCelTxed
TCelRdClk
From Framer/PLCP
Scrambler
Idle Cell
Generator
OAM
Processor
TCelData[7:0]
ScramblerEn
TxCPInt
To Interrupt
Block
HECDat[7:0]
HeaderLoc
OAMCycle
OAMDataL[7:0]
OAMDataH[7:0]
ICDat[7:0]
From TxUtopia
To/From Pins
TxCPRegSel
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