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參數(shù)資料
| 型號(hào)： | DSP16210 |
| 英文描述： | TVS 400W 6.5V UNIDIRECT SMA |
| 中文描述： | DSP16210數(shù)字信號(hào)處理器 |
| 文件頁(yè)數(shù)： | 98/173頁(yè) |
| 文件大小： | 2621K |
| 代理商： | DSP16210 |
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Data Sheet
July 2000
DSP16210 Digital Signal Processor
98
DRAFT COPY
Lucent Technologies Inc.
Software Architecture
(continued)
Registers
(continued)
Register Settings
(continued)
Table 53. ins (Interrupt Status) Register
Note:
An instruction clears an interrupt and resets its source to the not pending state by writing a one to the corre-
sponding bit in the
ins
register. Writing a zero to any bit leaves the bit unchanged.
19—16
Reserved
15
14
13
12
11
10
EOBE
5
INT0
EIBF
4
MOBE1
ECOL
3
MIBF1
EOFE
2
MOBE0
EIFE
1
MIBF0
TIME1
0
Reserved
9
8
7
6
TIME0
INT3
INT2
INT1
Bit
Field
Reserved
EOBE
EIBF
ECOL
EOFE
EIFE
TIME1
TIME0
INT3
INT2
INT1
INT0
MOBE1
MIBF1
MOBE0
MIBF0
Value
—
0
Description
19—16
15—0
Reserved—write with zero.
Read—corresponding interrupt not pending.
Write—no effect.
1
Read—corresponding interrupt is pending.
Write—clears bit and changes corresponding interrupt status to not pending
.
The core clears an interrupt’s
ins
bit if it services that interrupt. For interrupt polling, an instruction can explicitly clear an interrupt’s
ins
bit by writing a 1
to that bit and a 0 to all other
ins
bits. Writing a 0 to any
ins
bit leaves the bit unchanged.
To clear an interrupt’s status, an application writes a 1 to the corresponding bit.
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