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參數(shù)資料
| 型號： | DSP16210 |
| 英文描述： | TVS 400W 6.5V UNIDIRECT SMA |
| 中文描述： | DSP16210數(shù)字信號處理器 |
| 文件頁數(shù)： | 138/173頁 |
| 文件大小： | 2621K |
| 代理商： | DSP16210 |
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Data Sheet
July 2000
DSP16210 Digital Signal Processor
138
DRAFT COPY
Lucent Technologies Inc.
Timing Characteristics and Requirements
Timing characteristics refer to the behavior of the device under specified conditions. Timing requirements refer to
conditions imposed on the user for proper operation of the device. All timing data is valid for the following condi-
tions:
T
A
= –40
°
C to +85
°
C (See
Recommended Operating Conditions on page 133
.)
V
DD
= 3.3 V
±
0.3 V, V
SS
= 0 V (See
Recommended Operating Conditions on page 133
.)
Capacitance load on outputs (C
L
) = 50 pF
Output characteristics can be derated as a function of load capacitance (C
L
).
All outputs except CKO:
0.025 ns/pF
≤
dt/dC
L
≤
0.07 ns/pF for 10
≤
C
L
≤
100 pF
0.01 ns/pF
≤
dt/dC
L
≤
0.025 ns/pF for 10
≤
C
L
≤
100 pF
at V
IH
for rising edge and at V
IL
for falling edge
CKO:
For example, if the actual load capacitance on a pin other than CKO is 30 pF instead of 50 pF, the maximum derat-
ing for a rising edge is (30 – 50) pF x 0.07 ns/pF = 1.4 ns
less
than the specified rise time or delay that includes a
rise time. The minimum derating for the same 30 pF load would be (30 – 50) pF x 0.025 ns/pF = 0.5 ns.
Test conditions for inputs:
Rise and fall times of 4 ns or less
Timing reference levels for delays = V
IH
, V
IL
Test conditions for outputs (unless noted otherwise):
C
LOAD
= 50 pF
Timing reference levels for delays = V
IH
, V
IL
3-state delays measured to the high-impedance state of the output driver
Unless otherwise noted, CKO in the timing diagrams is the free-running CKO.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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| DSP1627F32K11IR | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DSP|16-BIT|CMOS|QFP|100PIN|PLASTIC |
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