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參數(shù)資料
| 型號： | DSP16210 |
| 英文描述： | TVS 400W 6.5V UNIDIRECT SMA |
| 中文描述： | DSP16210數(shù)字信號處理器 |
| 文件頁數(shù)： | 117/173頁 |
| 文件大?。?/td> | 2621K |
| 代理商： | DSP16210 |
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Data Sheet
July 2000
DSP16210 Digital Signal Processor
Lucent Technologies Inc.
DRAFT COPY
117
Pin Information
(continued)
Functional descriptions of TQFP pins 1—144 are found in
Signal Descriptions beginning on page 121
. Input levels
on all I (input) and I/O (input/output) type pins are designed to remain at full CMOS levels when not driven. At full
CMOS levels, no significant dc current is drawn. Although input and I/O buffers can be left untied, it is recom-
mended that unused input pins (and I/O pins that are configured as inputs) be tied to V
SS
or V
DD
through a 10 k
resistor.
Table 80. Pin Descriptions
TQFP Pin
Symbol
Type
Name/Function
Pin State During Reset
(RSTB = 0)
Pin State After
Reset
(RSTB 0
→
1)
3-state
91, 93, 94, 95,
96, 99, 100,
101, 102, 104,
105, 106, 107,
110, 111, 112
113
DB[15:0]
I/O External Memory Data Bus
15—0
3-state
IO
O
Y-Memory Address Space
External I/O Enable
INT0 = 0
(deasserted)
INT0 = 1
(asserted)
INT0 = 0
(deasserted)
INT0 = 1
(asserted)
INT0 = 0
(deasserted)
INT0 = 1
(asserted)
INT0 = 0
(deasserted)
INT0 = 1
(asserted)
INT0 = 0
(deasserted)
INT0 = 1
(asserted)
INT0 = 0
(deasserted)
INT0 = 1
(asserted)
logic high
logic high
3-state
116
ERAMHI
O
Y-Memory Address Space
External RAM High Enable
logic high
logic high
3-state
117
ERAMLO
O
Y-Memory Address Space
External RAM Low Enable
logic high
logic high
3-state
114
ERAM
O
Y-Memory Address Space
External RAM Enable
logic high
logic high
3-state
118
EROM
O
X-Memory Address Space
External ROM Enable
logic high
logic high
3-state
119
RWN
O
EMI Read/Write Not Indicator
logic high
logic high
3-state
120
23
EXM
READY
I
I
External Memory Boot Select
External Memory Access
Acknowledge
—
—
—
—
§
The
ioc
register (see
Table 54 on page 99
) is cleared after reset, including its EBIO field that controls the multiplexing of the VEC0/IOBIT7,
VEC1/IOBIT6, VDC2/IOBIT5, and VEC3/IOBIT4 pins. After reset, these pins are configured as the VEC[3:0] outputs and are logic high.
If unused, this pin must be pulled low through a 10 k
resistor to V
SS
.
§§ 3-states if RSTB = 0 or
PHIFC
[PCFIG] = 0.
During and after reset, the internal clock is selected as the CKI input pin and the CKO output pin is selected as the internal clock.
This pin his internal pull-up circuitry.
3-states by JTAG control.
相關(guān)PDF資料 |
PDF描述 |
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