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參數(shù)資料
| 型號(hào)： | DSP16210 |
| 英文描述： | TVS 400W 6.5V UNIDIRECT SMA |
| 中文描述： | DSP16210數(shù)字信號(hào)處理器 |
| 文件頁(yè)數(shù)： | 112/173頁(yè) |
| 文件大?。?/td> | 2621K |
| 代理商： | DSP16210 |
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Data Sheet
July 2000
DSP16210 Digital Signal Processor
112
DRAFT COPY
Lucent Technologies Inc.
Software Architecture
(continued)
Registers
(continued)
Register Settings
(continued)
Table 73. vsw (Viterbi Support Word) Register
15—6
5
4
3
2
1
0
Reserved
VEN
MAX
TB2
Reserved CFLAG1 CFLAG0
Bit
Field
Reserved
VEN
Value
—
0
1
0
1
0
Description
15—6
5
Reserved—write with zero.
Disables Viterbi side effects.
Enables Viterbi side effects.
The
cmp0( )
,
cmp1( )
, and
cmp2( )
functions select minimum of input operands.
The
cmp0( )
,
cmp1( )
, and
cmp2( )
functions select maximum of input operands.
The traceback encoder stuffs one traceback bit into
ar0
for the
cmp1( )
function or
stuffs one old traceback bit from
ar0
into
ar1
for the
cmp0( )
function
(GSM/IS95-compatible mode).
The traceback encoder stuffs two traceback bits into
ar0
for the
cmp1( )
function or
stuffs two old traceback bits from
ar0
into
ar1
for the
cmp0( )
function
(IS54/IS136-compatible mode).
Reserved—write with zero.
Previous value of CFLAG0. The traceback encoder copies the value of CFLAG0 to
CFLAG1 if the DAU executes a
cmp2( )
function and VEN=1.
Previous value of CFLAG
. The traceback encoder copies the value of CFLAG to
CFLAG0 if the DAU executes a
cmp2( )
function and VEN=1.
For the
cmp2(aSE,aDE)
function, CFLAG=0 if MAX=0 and aSE
≥
aDE or if MAX=1 and aSE
<
aDE, and CFLAG=1 if MAX=0 and aSE
<
aDE
or if MAX=1 and aSE
≥
aDE.
4
MAX
3
TB2
1
2
1
Reserved
CFLAG1
—
—
0
CFLAG0
—
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| DSP1627 | TVS 400W 6.5V BIDIRECT SMA |
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參數(shù)描述 |
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