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Data Sheet
July 2000
DSP16210 Digital Signal Processor
Lucent Technologies Inc.
DRAFT COPY
25
Hardware Architecture
(continued)
Memory Maps
Figure 5 shows the DSP16210 X-memory space memory map (XMAP).
Figure 6 on page 26
shows the DSP16210
Y-memory space memory maps (YMAP0 and YMAP1). Instructions differentiate between the X- and Y-memory
spaces by the addressing unit (i.e., the set of pointers) used for the access and not by the physical memory
accessed. Although the memories are 16-bit word-addressable, data or instruction widths can be either 16 bits or
32 bits and the internal memories can be accessed 32 bits at a time. The internal DPRAM is organized into even
and odd interleaved banks as shown in Figure 4. The core data buses (XDB and YDB) are 32 bits wide, so the core
can access 32-bit DPRAM data that has an aligned (even) address in a single cycle.
Figure 4. Interleaved Internal DPRAM
Figure 5. X-Memory Space Memory Map
0x000
0x003
0x001
0x002
0x7FF
0x7FE
11 LSBs
OF
ADDRESS
16 bits
16 bits
32 bits
EVEN BANK
ODD BANK
11 LSBs
OF
ADDRESS
DPRAM MODULE
1K x 32 bits
(2 Kwords)
0x1FFFF
0x00000
.
0x1FFFD
DPRAM
60 Kwords
CACHE
62 words
RESERVED
0x1FFC0
0x0EFFF
0x22000
0x7FFFF
0x20000
.
0x21FFF
0x80000
.
IROM 8 Kwords
(RESET AND SYSTEM TRAP
VECTORS; HDS AND BOOT
CODE)
RESERVED
0x1FFFE
0x0F000
0x1FFBF
XMAP (16 bits)
MEMORY SEGMENT
RESERVED
EROM
(64 Kwords)
0x8FFFF
0x90000
0xFFFFF
These locations are modularly mapped into the previous segment (EROM). For example, location 0xA0000 maps to location 0x80000.
RESERVED
16 bits
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