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參數(shù)資料
| 型號(hào)： | DSP16210 |
| 英文描述： | TVS 400W 6.5V UNIDIRECT SMA |
| 中文描述： | DSP16210數(shù)字信號(hào)處理器 |
| 文件頁(yè)數(shù)： | 91/173頁(yè) |
| 文件大?。?/td> | 2621K |
| 代理商： | DSP16210 |
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Data Sheet
July 2000
DSP16210 Digital Signal Processor
Lucent Technologies Inc.
DRAFT COPY
91
Software Architecture
(continued)
Registers
(continued)
Register Settings
Tables
42
through
73
describe the programmable registers of the DSP16210 device.
Table 42. alf Register
15
AWAIT
Reserved
14
—
10
9
8
7
6
5
4
3
2
1
0
JOBF
JIBE
JCONT LOCK MBUSY1 MBUSY0 SOMEF SOMET
ALLF
ALLT
Bit
15
Field
Value
0
1
0
0
1
0
1
—
Description
AWAIT
Await
The core is not in low-power standby mode.
Enter low-power standby mode.
Reserved—write with zero.
JTAG
jiob
output buffer is empty.
JTAG
jiob
output buffer is full.
JTAG
jiob
input buffer is full.
JTAG
jiob
input buffer is empty.
JTAG continue flag.
14—10 Reserved
9
—
JOBF
JTAG Output
Buffer Full
JTAG Input
Buffer Empty
JTAG
Continue
PLL Lock
8
JIBE
7
JCONT
6
LOCK
0
1
0
1
0
1
0
PLL is not phase-locked.
PLL is phase-locked.
MIOU1 output is complete.
MIOU1 unfinished output is pending.
MIOU0 output is complete.
MIOU0 unfinished output is pending.
All tested BIO input pins match the test pattern in
cbit
[7:0], no BIO input
pins are tested, or all BIO pins are configured as outputs.
Some tested BIO inputs pins do not match the test pattern in
cbit
[7:0],
i.e., no tested BIO pins match the pattern or some (but not all) tested
BIO pins match the pattern.
No tested BIO input pins match the test pattern in
cbit
[7:0], no BIO
input pins are tested, or all BIO pins are configured as outputs.
Some or all tested BIO input pins match the test pattern in
cbit
[7:0].
5
MBUSY1
§
MIOU1 Busy
4
MBUSY0
§
MIOU0 Busy
3
SOMEF
BIO Some
False
(Inverse of
ALLT)
1
2
SOMET
BIO Some
True
(Inverse of
ALLF)
BIO All False
(Inverse of
SOMET)
BIO All True
(Inverse of
SOMEF)
0
1
1
ALLF
0
1
Some or all tested BIO input pins match the test pattern in
cbit
[7:0].
No tested BIO input pins match the test pattern in
cbit
[7:0], no BIO
input pins are tested, or all BIO pins are configured as outputs.
Some tested BIO inputs pins do not match the test pattern in
cbit
[7:0],
i.e., no tested BIO pins match the pattern or some (but not all) tested
BIO pins match the pattern.
All tested BIO input pins match the test pattern in
cbit
[7:0], no BIO input
pins are tested, or all BIO pins are configured as outputs.
0
ALLT
0
1
The AWAIT bit is the only bit in
alf
that is cleared on reset.
LOCK is cleared whenever the
pllc
register is written.
§ The MBUSY1 and MBUSY0 flags are read only (writes to these flags are ignored).
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| DSP1627 | TVS 400W 6.5V BIDIRECT SMA |
| DSP1629 | TVS 400W 64V UNIDIRECT SMA |
| DSP16410C | TVS 400W 7.0V UNIDIRECT SMA |
| DSP16410 | 16-bit fixed point DSP with Flash |
| DSP25-16AR | Phase-leg Rectifier Diode |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| DSP1627F32K10IR | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DSP|16-BIT|CMOS|QFP|100PIN|PLASTIC |
| DSP1627F32K10IT | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DSP|16-BIT|CMOS|QFP|100PIN|PLASTIC |
| DSP1627F32K11I | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:16-Bit Digital Signal Processor |
| DSP1627F32K11IR | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DSP|16-BIT|CMOS|QFP|100PIN|PLASTIC |
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