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參數(shù)資料
| 型號： | DSP16210 |
| 英文描述： | TVS 400W 6.5V UNIDIRECT SMA |
| 中文描述： | DSP16210數(shù)字信號處理器 |
| 文件頁數(shù)： | 158/173頁 |
| 文件大?。?/td> | 2621K |
| 代理商： | DSP16210 |
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Data Sheet
July 2000
DSP16210 Digital Signal Processor
158
DRAFT COPY
Lucent Technologies Inc.
Timing Characteristics and Requirements
(continued)
PHIF16
(continued)
Note:
This diagram assumes an 8-bit external interface.
Figure 43. PHIF16 MotorolaMode Signaling (Pulse Period and Flags) Timing Diagram
Table 115. Timing Characteristics for PHIF16 MotorolaMode Signaling (Pulse Period and Flags)
Abbreviated Reference
t53
t54
Parameter
Min
—
—
Max
15
15
Unit
ns
ns
An input/output transaction is initiated by PCSN or PDS going low, whichever comes last. For example, t53 and t54 should be referenced to
PDS going low, if PDS goes low after PCSN. An input/output transaction is completed by PCSN or PDS going high, whichever comes first.
All requirements referenced to PCSN should be referenced to PDS, if PDS is the controlling signal. PRWN should never be used to initiate
or complete a transaction.
PDS is programmable to be active-high or active-low. It is shown active-low in Figure 43. POBE and PIBF may be programmed to be the
opposite logic levels shown in the diagram. t53 and t54 apply to the inverted levels as well as those shown.
PCSN/PDS
to POBE
(high to high)
PCSN/PDS
to PIBF
(high to high)
Table 116. Timing Requirements for PHIF16 MotorolaMode Signaling (Pulse Period and Flags)
Abbreviated Reference
t55
t56
Parameter
Min
20
20
Max
—
—
Unit
ns
ns
PCSN/PDS/PRWN Pulse Width (high to low)
PCSN/PDS/PRWN Pulse Width (low to high)
5-4039(F).a
PDS
PRWN
V
IH
–
V
IL
–
t55
t56
t55
t56
t55
t56
PCSN
t53
t54
16-bit READ
8-bit WRITE
PBSEL
POBE
PIBF
t54
t56
t56
t55
t53
8-bit READ
16-bit WRITE
V
IH
–
V
IL
–
V
IH
–
V
IL
–
V
OH
–
V
OL
–
V
OH
–
V
OL
–
V
OH
–
V
OL
–
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PDF描述 |
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