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參數(shù)資料
| 型號： | PowerPC 603e |
| 廠商： | Motorola, Inc. |
| 英文描述： | 32-Bit Microprocessor(32位微處理器) |
| 中文描述： | 32位微處理器（32位微處理器） |
| 文件頁數(shù)： | 60/455頁 |
| 文件大?。?/td> | 1048K |
| 代理商： | POWERPC 603E |
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1-20
MPC603e & EC603e RISC Microprocessors User's Manual
MOTOROLA
1.3.1.10 Special-Purpose Registers (SPRs)
The PowerPC operating environment architecture defines numerous special-purpose
registers that serve a variety of functions, such as providing controls, indicating status,
configuring the processor, and performing special operations. During normal execution, a
program can access the registers, shown in Figure 2-1, depending on the program’s access
privilege (supervisor or user, determined by the privilege-level (PR) bit in the MSR). Note
that registers such as the GPRs and FPRs (not supported by the EC603e microprocessor)
are accessed through operands that are part of the instructions. Access to registers can be
explicit (that is, through the use of specific instructions for that purpose such as Move to
Special-Purpose Register (
mtspr
) and Move from Special-Purpose Register (
mfspr
)
instructions) or implicit, as the part of the execution of an instruction. Some registers are
accessed both explicitly and implicitly
In the 603e, all SPRs are 32 bits wide.
1.3.1.10.1 User-Level SPRs
The following 603e SPRs are accessible by user-level software:
Link register (LR)—The link register can be used to provide the branch target
address and to hold the return address after branch and link instructions. The LR is
32 bits wide in 32-bit implementations.
Count register (CTR)—The CTR is decremented and tested automatically as a result
of branch-and-count instructions. The CTR is 32 bits wide in 32-bit
implementations.
XER register—The 32-bit XER contains the summary overflow bit, integer carry bit,
overflow bit, and a field specifying the number of bytes to be transferred by a Load
String Word Indexed (
lswx
) or Store String Word Indexed (
stswx
) instruction.
1.3.1.10.2 Supervisor-Level SPRs
The 603e also contains SPRs that can be accessed only by supervisor-level software. These
registers consist of the following:
The 32-bit DSISR defines the cause of data access and alignment exceptions.
The data address register (DAR) is a 32-bit register that holds the address of an
access after an alignment or DSI exception.
Decrementer register (DEC) is a 32-bit decrementing counter that provides a
mechanism for causing a decrementer exception after a programmable delay.
The 32-bit SDR1 specifies the page table format used in virtual-to-physical address
translation for pages. (Note that physical address is referred to as real address in the
architecture specification.)
The machine status save/restore register 0 (SRR0) is a 32-bit register that is used by
the 603e for saving the address of the instruction that caused the exception, and the
address to return to when a Return from Interrupt (
rfi
) instruction is executed.
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