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參數(shù)資料
| 型號： | 20665 |
| 英文描述： | ?lanSC310 Programmer＇s Reference Manual |
| 中文描述： | ？lanSC310程序員參考手冊 |
| 文件頁數(shù)： | 27/186頁 |
| 文件大?。?/td> | 918K |
| 代理商： | 20665 |
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1-16
Power Management
1.3
CLOCK-SWITCHING LOGIC
The élanSC310 microcontroller’s clock-switching logic handles the task of switching clock
speeds as directed by the PMU or other input, and sequencing the shutdown and startup
of the clocks and PLLs.
1.3.1
CPU/Memory Clock Switching
The CPU clock-switching circuit delivers a signal that switches cleanly between the high-
speed PLL clock and a low-speed clock source in High-Speed PLL mode. The low-speed
clock source switches cleanly between the low-speed PLL clock (9.2 MHz) and a select-
able slow clock on a PMU state transition (see Table 1-1 on page 1-6).
The high-speed PLL clock is used only under narrowly defined conditions. The high-
speed clock must be enabled by setting bit 6 of the I/O Wait State register at Index 61h.
Doing this enables the use of the high-speed clock after the next refresh cycle if the high-
speed PLL is already started.
In addition, the PMU must be in High-Speed PLL mode and the current bus cycle must be
one of the following types of cycles:
I
CPU idle
I
Local DRAM
I
Fast ROM
I
Local bus
Use of the high-speed clock is disallowed when all of the following conditions are true:
I
BL1 is Low
I
Bit 5 of the PMU Control 2 register at Index AFh has been set to enable this feature
I
ACIN is Low
If the auto low-speed logic is enabled, use of the high-speed clock is disallowed periodi-
cally to conserve power. In cases where the use of the high-speed PLL clock is disal-
lowed, the low-speed PLLs 9.2-MHz CPU clock is used.
When the PMU is in Low-Speed PLL mode, the CPU clock is generated from the low-
speed clock source. This is a programmable divider chain controlled by bits 1–0 of the
PMU Control 3 register at Index ADh which provides a clock frequency of 9.216 MHz that
is divided by 2, 4, 8, or 16. These bits should be changed only when the PMU is not in
Low-Speed PLL mode.
When a temporary-on condition occurs while the PMU is in Doze, Sleep, Suspend, or Off
mode—and the CPU/memory clock is enabled to run—the 9.2-MHz CPU clock is used.
The high-speed PLL clock frequency may be selected by writing to bits 4–3 of the Func-
tion Enable 2 register at Index B1h. These bits should not be changed when the high-
speed clock is enabled.
1.3.2
Clock Startup and Shutdown Logic
The clock startup and shutdown logic provides a mechanism for properly coordinating the
activation of the élanSC310 microcontroller’s PLLs with the CPU’s clock-enabling logic.
The flowchart in Figure 1-2 on page 1-18 illustrates the logic flow. For the high-speed
clock, there is a choice of turning off the PLL in either Low-Speed PLL mode or Doze
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 20668 | ?lanSC300 Data Sheet ?lanSC310 Data Sheet |
| 2067 | SAFETY SWITCH FERROCODE |
| 2070 | SAFETY SWITCH FERROCODE |
| 2068 | SAFETY SWITCH FERROCODE |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 20-665000-00 | 功能描述:IC 與器件插座 SOWIC TO SOIC ADAPT 20 PINS RoHS:否 制造商:Molex 產(chǎn)品:LGA Sockets 節(jié)距:1.02 mm 排數(shù): 位置/觸點(diǎn)數(shù)量:2011 觸點(diǎn)電鍍:Gold 安裝風(fēng)格:SMD/SMT 端接類型:Solder 插座/封裝類型:LGA 2011 工作溫度范圍:- 40 C to + 100 C |
| 20-665000-00-P | 制造商:ARIES 制造商全稱:Aries Electronics, Inc. 功能描述:SOWI-to-SOIC Adapter |
| 206650-1 | 制造商:TE Connectivity 功能描述:206650-1 |
| 2066531 | 制造商: 功能描述: 制造商:TE Connectivity 功能描述: 制造商:undefined 功能描述: |
| 206653-1 | 制造商: 功能描述: 制造商:undefined 功能描述: |
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