參數(shù)資料
型號： 20665
英文描述： ?lanSC310 Programmer＇s Reference Manual
中文描述： ？lanSC310程序員參考手冊
文件頁數(shù)： 176/186頁
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代理商： 20665
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INDEX
I-11
MEMADRS0 bit,
4-69
MEMADRS1 bit,
4-69
MEMCTLS0 bit,
4-69
MEMCTLS1 bit,
4-69
MEMDATS0 bit,
4-69
MEMDATS1 bit,
4-69
Memory Configuration 1 Register (Index 66h)
bit descriptions,
4-28
bus option status (table),
4-28
DRAM memory configuration,
2-3
memory configuration (DRAM) (table),
4-28
setting up Page-mode DRAM accesses,
2-4
Memory Configuration 2 Register (Index B9h)
bit descriptions,
4-69
I/O drive type description (table),
4-69
Off mode function,
1-7
output drive strength select logic (table),
4-69
memory management. See alsoMemory Mapping Sys-
tem (MMS).
16-Mbyte address spaces,
2-1
64-Mbyte address spaces,
2-1
80-ns DRAM support,
2-17
DOS chip-select signal,
2-16
–
2-17
DOSCS wait-state control-bit logic (table),
2-16
high-speed clock ROM cycles,
2-15
overview,
2-1
ROM BIOS memory,
2-6
–
2-7
address initialization (table),
2-6
copy ROM contents (figure),
2-7
high memory (figure),
2-6
ROM chip-select command gating,
2-14
ROM chip-select signal,
2-15
ROMCS wait-state control-bit logic (table),
2-16
ROM DOS memory,
2-8
self-refresh DRAMs,
2-17
system memory. See alsoDRAM configurations,
2-3
system memory. See alsoDRAM,
2-2
–
2-6
ISA and local bus configurations,
2-5
–
2-6
overview,
2-2
–
2-3
refresh and wait states,
2-3
–
2-5
typical AT address space (figure),
2-2
wait states and command delays,
2-14
command delay duration for various cycles (table),
2-14
wait states for various cycles (table),
2-15
Memory Mapping System (MMS). See alsospecific
MMS bits and registers.
2-9
–
2-13
memory mapping system (figure),
2-9
MMS mapping example (figure),
2-12
MMS mapping example settings (table),
2-13
MMSA and MMSB (figure),
2-10
registers for setting up,
2-10
,
4-6
Memory Write Activity Lower Boundary Register (Index
9Ah)
bit descriptions,
4-50
hit-count limit bit logic (table),
4-51
PMU operating-mode transitions,
1-8
Memory Write Activity Upper Boundary Register (Index
9Bh)
bit descriptions,
4-50
PMU operating-mode transitions,
1-8
MEMR signal
disabling,
4-18
quiet bus feature,
1-41
MEMW signal
disabling,
4-18
quiet bus feature,
1-41
merging PMU modes,
1-9
Micro Power Off mode,
1-40
mirrored I/O register conflicts (note),
3-1
Miscellaneous 1 Register (Index 6Fh)
bit descriptions,
4-34
MMS memory range select logic (table),
4-34
–
4-35
preventing overlap of linear-decode address range,
2-8
Miscellaneous 2 Register (Index 6Bh)
bit descriptions,
4-30
enabling SMIs,
1-27
Miscellaneous 3 Register (Index BAh)
bit descriptions,
4-70
Miscellaneous 4 Register (Index 44h)
bit descriptions,
4-15
data-path disabling logic,
1-41
powered-down device SMIs,
1-29
Miscellaneous 5 Register (Index B3h)
bit descriptions,
4-65
controlling number of wait states,
2-16
determining source of SMIs,
1-28
enabling high-speed clock rate,
2-15
ROM BIOS enable and wait-state select logic (table),
4-66
Miscellaneous 6 Register (Index 70h)
bit descriptions,
4-35
generating PMU-activity event with ACIN pin,
1-34
相關PDF資料
PDF描述
20668 ?lanSC300 Data Sheet ?lanSC310 Data Sheet
2067 SAFETY SWITCH FERROCODE
2070 SAFETY SWITCH FERROCODE
2068 SAFETY SWITCH FERROCODE
2068-6104-015 Flange Mount Medium Power Terminations
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參數(shù)描述
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20-665000-00-P 制造商:ARIES 制造商全稱:Aries Electronics, Inc. 功能描述:SOWI-to-SOIC Adapter
206650-1 制造商:TE Connectivity 功能描述:206650-1
2066531 制造商: 功能描述: 制造商:TE Connectivity 功能描述: 制造商:undefined 功能描述:
206653-1 制造商: 功能描述: 制造商:undefined 功能描述:
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