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參數(shù)資料
| 型號： | ARM966E-S |
| 英文描述： | ARM966E-S Microprocessor Core preliminary technical manual 6/01 |
| 中文描述： | ARM966E - ?微處理器核的初步技術(shù)手冊6月1日 |
| 文件頁數(shù)： | 25/166頁 |
| 文件大小： | 1145K |
| 代理商： | ARM966E-S |
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AHB Interface
Rev. A
2-5
Copyright 1999-2001 by LSI Logic Corporation. All rights reserved.
The signals indicate whether the transfer is an opcode
fetch or data access, and whether the transfer is a
supervisor mode access or user mode access.
Note that for the ARM966E-S, HPROT3 is forced LOW
(noncacheable).
HRDATA[31:0] Read Data Bus
This bus transfers data from the bus slaves to the
ARM966E-S during read operations. The ARM966E-S
has a 32-bit wide data bus. The width can be easily
extended outside the core to allow for higher bandwidth
operation.
Input
HREADY
Transfer Done
When HIGH, the HREADY signal indicates the transfer on
the bus has finished. Drive this signal LOW to extend a
transfer.
Input
Note: Slaves on the bus require HREADY to be both an
input and an output.
HRESETn
Reset
This input is the active-LOW system reset.
Input
HRESP[1:0]
Transfer Response
HRESP[1:0] provide additional information on the status
of a transfer. When a slave must insert a number of wait
Input
HPROT3
Cacheable
HPROT2
Bufferable
HPROT1
Supervisor
HPROT0
Data/Opcode Description
–
–
–
–
–
–
0
–
–
–
–
0
1
–
–
–
0
1
–
–
–
0
1
–
–
–
–
–
Opcode Fetch
Data Access
User Access
Supervisor Access
Not Bufferable
Bufferable
Not Cacheable
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ARS2569 | Amplifier. Other |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| ARMADA166E | 制造商:MARVELL 制造商全稱:MARVELL 功能描述:Industry’s Most Complete Integrated Solution |
| ARMADA166E_1 | 制造商:MARVELL 制造商全稱:MARVELL 功能描述:Industry’s First Application Processor with Integrated EPD Controller Scalable to 800 MHz for Cost-Sensitive, High-Performance eReaders and eBooks |
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