參數(shù)資料
型號(hào)： ARM966E-S
英文描述： ARM966E-S Microprocessor Core preliminary technical manual 6/01
中文描述： ARM966E - ?微處理器核的初步技術(shù)手冊(cè)6月1日
文件頁數(shù)： 122/166頁
文件大?。?/td> 1145K
代理商： ARM966E-S
10-6
Debug
Rev. A
Copyright 1999-2001 by LSI Logic Corporation. All rights reserved.
Figure 10.3 Clock Synchronization Logic
10.3 Scan Chain 15
Scan chain 15 (SC15) provides debug access to the CP15 register bank,
allowing the system state within the ARM966E-S to be configured while
in the debug state.
Table 10.1 shows the order of SC15 from the DBGTDI input to the
DBGTDO output.
DBGTMS
DBGTDI
MultiICE
Interface
Pads
DBGnTRST
DBGTDO
DBGTCKEN
TDO
RTCK
TCK
CLK
TMS
D
Q
TCK Synchronizer
D
Q
D
Q
CLK
CLK
CLK
A
Input sample and hold
TDI
D
Q
D
Q
Table 10.1
Scan Chain 15 Addressing Mode Bit Order
Bits
Contents
38
Read = 0, write = 1
37:32
CP15 register address
31:0
CP15 register value
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