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參數(shù)資料
| 型號： | FW82815 |
| 英文描述： | Controller Miscellaneous - Datasheet Reference |
| 中文描述： | 控制器雜項-數(shù)據(jù)表參考 |
| 文件頁數(shù)： | 98/172頁 |
| 文件大?。?/td> | 795K |
| 代理商： | FW82815 |
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82815 GMCH
R
98
Datasheet
3.5.20.
PMLIMIT—Prefetchable Memory Limit Address Register
(Device 1)
Address Offset:
26–27h
Default Value:
0000h
Access:
Read/Write
Size:
16 bits
This register controls the processor to PCI1 prefetchable memory accesses routing based on the
following formula.
PREFETCHABLE_MEMORY_BASE
≤
address
≤
PREFETCHABLE_MEMORY_LIMIT
The upper 12 bits of the register are read/write and correspond to the upper 12 address bits A[31:20] of
the 32 bit address. The bottom 4 bits of this register are read-only and return zeroes when read. The
configuration software must initialize this register. For the purpose of address decode, address bits
A[19:0] are assumed to be FFFFFh. Thus, the top of the defined memory address range will be at the top
of a 1 MB aligned memory block.
15
4
3
0
Prefetchable Memory Address Limit
Reserved
Bit
Description
15: 4
Prefetchable Memory Address Limit (PMEM_LIMIT).
Corresponds to A[31:20] of the memory
address. (Default=0)
3:0
Reserved.
Note:
Prefetchable memory range is supported to allow segregation by the configuration software between the
memory ranges that must be defined as UC and the ones that can be designated as a USWC
(i.e., prefetchable) from the processor perspective
.
相關(guān)PDF資料 |
PDF描述 |
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| FWA-30A10F | Fuse |
| FWA-35A21F | Fuse |
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