- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄370261 > FW82815 Controller Miscellaneous - Datasheet Reference PDF資料下載
參數(shù)資料
| 型號： | FW82815 |
| 英文描述： | Controller Miscellaneous - Datasheet Reference |
| 中文描述： | 控制器雜項(xiàng)-數(shù)據(jù)表參考 |
| 文件頁數(shù)： | 104/172頁 |
| 文件大?。?/td> | 795K |
| 代理商： | FW82815 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁當(dāng)前第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁
82815 GMCH
R
104
Datasheet
3.6.3.
PCICMD2—PCI Command Register (Device 2)
Address Offset:
Default:
Access:
Size:
04h
05h
0004h
Read-Only, Read/Write
16 bits
This 16-bit register provides basic control over the chipset’s ability to respond to PCI cycles. The
PCICMD Register in the GMCH disables PCI compliant master accesses to main memory.
15
10
9
8
Reserved (0)
FB2B
(Not Impl)
SERR En
(Not Impl)
7
6
5
4
3
2
1
0
Addr/Data
Stepping
(Not Impl)
Parity
Error En
(Not Impl)
VGA Pal
Sn
(Not Impl)
Mem WR
& Inval En
(Not Impl)
Special
Cycle En
(Not Impl)
Bus
Master En
(Enabled)
Mem Acc
En
I/O Acc En
Bits
Description
15:10
Reserved.
9
Fast Back-to-Back (FB2B)
RO.
(Not Implemented). Hardwired to 0.
8
SERR# Enable (SERRE)
RO.
(Not Implemented). Hardwired to 0.
7
Address/Data Stepping
RO.
(Not Implemented). Hardwired to 0.
6
Parity Error Enable (PERRE)
the category of devices that does not corrupt programs or data in system memory or hard drives, the
GMCH ignores any parity error that it detects and continues with normal operation.
RO.
(Not Implemented). Hardwired to 0. Since the GMCH belongs to
5
Video Palette Snooping (VPS)
RO.
Hardwired to 0. Disables snooping.
4
Memory Write and Invalidate Enable (MWIE)
memory write and invalidate commands.
RO.
Hardwired to 0. GMCH does not support
3
Special Cycle Enable (SCE)
RO.
Hardwired to 0. GMCH ignores Special cycles.
2
Bus Master Enable (BME)
master.
RO.
Hardwired to 1 to enable GMCH to function as a PCI compliant
1
Memory Access Enable (MAE)
accesses.
R/W.
This bit controls the GMCH’s response to memory space
0 = Disable (default).
1 = Enable.
0
I/O Access Enable (IOAE)
R/W.
This bit controls the GMCH’s response to I/O space accesses.
0 = Disable (default).
1 = Enable.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| FWA-25A10F | Fuse |
| FWA-30A10F | Fuse |
| FWA-35A21F | Fuse |
| FWA-40A21F | Fuse |
| FWA-45A21F | Fuse |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| FW82815 S L5NQ | 制造商:Intel 功能描述:Graphics and Memory Controller Hub 544-Pin BGA |
| FW82815EM S L4MP | 制造商:Intel 功能描述:GRAPHICS AND MEMORY CONTROLLER HUB (GMCH2-M) |
| FW82815SL5NQ | 制造商:Intel 功能描述: |
| FW828201CA | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Controller Miscellaneous - Datasheet Reference |
| FW82840 S L3TA | 制造商:Intel 功能描述:Memory Controller Hub 544-Pin BGA |
發(fā)布緊急采購，3分鐘左右您將得到回復(fù)。