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參數(shù)資料
| 型號： | FW82815 |
| 英文描述： | Controller Miscellaneous - Datasheet Reference |
| 中文描述： | 控制器雜項(xiàng)-數(shù)據(jù)表參考 |
| 文件頁數(shù)： | 20/172頁 |
| 文件大?。?/td> | 795K |
| 代理商： | FW82815 |
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82815 GMCH
R
20
Datasheet
1.9.
System Clocking
The 82815 GMCH has a new type of clocking architecture. It has integrated SDRAM buffers that run at
either 100 or 133 MHz, independent of the system bus frequency. See table below for supported system
bus and system memory bus frequencies. The system bus frequency is selectable between 66 MHz,
100 MHz, or 133 MHz. The GMCH uses a copy of the USB clock as the DOT Clock input for the
graphics pixel clock PLL.
Table 1. Supported System Bus and System Memory Bus Frequencies
Front Side Bus
Frequency
System Memory
Bus Frequency
Display Cache Interface
Frequency
66 MHz
100 MHz
133 MHz or DVMT
100 MHz
100 MHz
133 MHz or DVMT
133 MHz
100 MHz
133 MHz or DVMT
133 MHz
133 MHz
133 MHz or DVMT
1.10. GMCH Power Delivery
The 82815 GMCH core voltage is 1.85V. System memory operates from a 3.3V supply. Display cache
memory operates from the AGP 3.3V supply. AGP 1X/2X I/O can operate from either a 3.3V or a 1.5V
supply. AGP 4X I/O requires a 1.5V supply. The AGP interface voltage is determined by the VDDQ
generation on the motherboard.
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