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參數(shù)資料
| 型號： | FW82815 |
| 英文描述： | Controller Miscellaneous - Datasheet Reference |
| 中文描述： | 控制器雜項-數(shù)據(jù)表參考 |
| 文件頁數(shù)： | 57/172頁 |
| 文件大?。?/td> | 795K |
| 代理商： | FW82815 |
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82815 GMCH
R
Datasheet
57
3.4.19.
FDHC—Fixed DRAM Hole Control Register (Device 0)
Address Offset:
58h
Default Value:
00h
Access:
Read/Write
Size:
8 bits
This 8-bit register controls a single fixed DRAM hole: 15 MB–16 MB.
7
6
0
Hole EN
Reserved
Bit
Description
7
Hole Enable (HEN).
This field enables a memory hole in DRAM space. Host cycles matching an
enabled hole are passed on to the I/O Controller Hub through the hub interface. Hub interface and PCI
cycles matching an enabled hole are ignored by the GMCH. Note that a selected hole is not re-mapped.
0 = No Hole Enabled
1 = 15 MB–16 MB (1MB) Hole Enabled
6:0
Reserved.
3.4.20.
PAM—Programmable Attributes Map Registers (Device 0)
Address Offset:
59–5Fh
Default Value:
00h
Attribute:
Read/Write
Size:
4 bits/register
The GMCH allows programmable memory attributes on 13
Legacy
memory segments of various sizes in
the 640 KB to 1 MB address range. Seven Programmable Attribute Map (PAM) Registers are used to
support these features. Cacheability of these areas is controlled via the MTRR registers in the P6
processor. Two bits are used to specify memory attributes for each memory segment. These bits apply to
both host, AGP/PCI, and hub interface initiator accesses to the PAM areas. These attributes are:
Read Enable (RE)
. When RE = 1, the processor read accesses to the corresponding memory
segment are claimed by the GMCH and directed to main memory. Conversely, when RE = 0, the
host read accesses are directed to the hub interface/PCI0.
Write Enable (WE)
. When WE = 1, the host write accesses to the corresponding memory segment
are claimed by the GMCH and directed to main memory. Conversely, when WE = 0, the host write
accesses are directed to the hub interface/PCI0.
The RE and WE attributes permit a memory segment to be Read-Only, Write Only, Read/Write, or
disabled. For example, if a memory segment has RE = 1 and WE = 0, the segment is Read-Only.
Each PAM Register controls two regions, typically 16 KB in size. Each of these regions has a 4-bit field.
The four bits that control each region have the same encoding and are defined in the following table.
相關PDF資料 |
PDF描述 |
|---|---|
| FWA-25A10F | Fuse |
| FWA-30A10F | Fuse |
| FWA-35A21F | Fuse |
| FWA-40A21F | Fuse |
| FWA-45A21F | Fuse |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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| FW82815SL5NQ | 制造商:Intel 功能描述: |
| FW828201CA | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Controller Miscellaneous - Datasheet Reference |
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