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參數(shù)資料
| 型號： | STD130 |
| 英文描述： | STD130|Data Sheet |
| 中文描述： | STD130 |數(shù)據(jù)資料 |
| 文件頁數(shù)： | 807/878頁 |
| 文件大?。?/td> | 2617K |
| 代理商： | STD130 |
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STD130
5-204
Samsung ASIC
DPSRAMBW_LP
Low-Power Dual-Port Synchronous Static RAM with Bit-Write
Logic Symbol
Function Description
DPSRAMBW_LP is a dual-port synchronous static RAM with bit-write capability which is provided as a
compiler. DPSRAMBW_LP is intended for use in Low-Power applications. Each port is fully independent.
Basically, its functionality is exactly same as DPSRAM_HD except a bit-write operation which is controlled
by BWEN1[](BWEN2[]), named bit-write enable signal bus. Each bit of BWEN1[](BWEN2[]) enables or
disable the write operation of its corresponding bit in DI1[](DI2[]). On the rising edge of CK1(CK2), the write
cycle is initiated when WEN1(WEN2) is low and CSN1(CSN2) is low. The data bits in DI1[](DI2[]), which
their corresponding bit(s) in BWEN1[](BWEN2[]) are low, are written into the memory location specified on
A1[](A2[]). When all bits of BWEN1[](BWEN2[]) are high, any data in DI1[](DI2[]) are not written into the
memory location specified on A1[](A2[]). When all bits of BWEN1[](BWEM2[]) are low, the data in
DI1[](DI2[]) are written into the memory location specified on A1[](A2[]), which is exactly same as the write
operation in DPSRAM_LP. During the write cycle, DOUT1[](DOUT2[]) remains stable. On the rising edge of
CK1(CK2), the read cycle is initiated when WEN1(WEN2) is high and CSN1(CSN2) is low. The data at
DOUT1[](DOUT2[]) become valid after a delay. While in standby mode that CSN1(CSN2) is high, A1[](A2[])
and DI1[](DI2[]) are disabled, data stored in the memory is retained and DOUT1[](DOUT2[]) remains stable.
When OEN1(OEN2) is high, DOUT1[](DOUT2[]) is placed in a high-impedance state.
Features
Suitable for low-power application
Separated data I/O
Synchronous operation
Duty-free clock cycle
Asynchronous tri-state output control
Latched inputs and outputs
Automatic power-down
Zero standby current
Zero hold time
Low noise output optimization
Flexible aspect ratio
Up to 256K bits capacity
Up to 16K number of words
Up to 128 number of bit per word
NOTES:
1. Words (w) is the number of words.
2. Bpw (b) is the number of bits per word.
3. Ymux (y) is one of the column mux types.
4. m =
log
2
w
CK1
CK2
CSN1
CSN2
WEN1
WEN2
BWEN1 [b-1:0]
BWEN2 [b-1:0]
dpsrambw_lp_<w>x<b>m<y>
DOUT1 [b-1:0]
OEN1
OEN2
A1 [m-1:0]
A2 [m-1:0]
DI1 [b-1:0]
DI2 [b-1:0]
DOUT2 [b-1:0]
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| STD131 | STD131|Data Sheet |
| STD150 | STD150|Data Sheet |
| STD15N06-1 | TRANSISTOR | MOSFET | N-CHANNEL | 60V V(BR)DSS | 15A I(D) | TO-251 |
| STD15N06L-1 | TRANSISTOR | MOSFET | N-CHANNEL | 60V V(BR)DSS | 15A I(D) | TO-251 |
| STD15N06LT4 | TRANSISTOR | MOSFET | N-CHANNEL | 60V V(BR)DSS | 15A I(D) | TO-252 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| STD13003 | 制造商:AUK 制造商全稱:AUK corp 功能描述:NPN Silicon Power Transistor |
| STD13003D | 制造商:KODENSHI 制造商全稱:KODENSHI KOREA CORP. 功能描述:NPN Silicon Power Transistor |
| STD13003L | 制造商:AUK 制造商全稱:AUK corp 功能描述:NPN Silicon Power Transistor |
| STD13003Q | 制造商:KODENSHI 制造商全稱:KODENSHI KOREA CORP. 功能描述:SWITCHING REGULATOR APPLICATIONS |
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