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參數(shù)資料
| 型號： | PM5311 |
| 英文描述： | ATM/SONET Transceiver |
| 中文描述： | ATM機/ SONET的收發(fā)器 |
| 文件頁數(shù)： | 52/544頁 |
| 文件大小： | 2537K |
| 代理商： | PM5311 |
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PM5317 SPECTRA-9953 Telecom Standard Product Data Sheet
Release
Proprietary and Confidential to PMC-Sierra, Inc., and for its customers’ internal use.
Document No.: PMC-2000741, Issue 5
52
Pin Name
Type
Pin
No.
Function
RALM1
RALM2
RALM3
RALM4
Output
R28
T27
R30
T29
The
receive alarm
(RALM1-4) signal is a multiplexed output of
individual alarms of the receive paths. Each alarm represents
the logical OR of the RSALM, LOP-P, AIS-P, RDI-P, ERDI-P,
LOPC-P, PAISC-P, UNEQ-P, PSLU, PSLM, PDI-P, TIU-P,
TIM-P status of the corresponding path. The selection of
alarms to be reported is controlled by the SPECTRA-9953
Alarm controller registers.
When the Spectra-9953 is processing four STS-48/STM-16
data streams, the STM-16 slice #1 must be active (software
slice reset is not set to 1) for the RALM port to operate
correctly.
RALM1-4 is updated on the falling edge of RRCPCLK.Please
refer to the individual alarm interrupt descriptions and
Functional Description Section for more details on each alarm.
13.5 Receive Path BIP-8 Error Signals
Pin Name
Type
Pin
Function
B3E1
B3E2
B3E3
B3E4
Output
AL15
AN16
AP16
AN17
The
bit interleaved parity error
(B3E1-4) signal carries the
path BIP-8 errors detected for each STS-192c/STS-48c/ STS-
12c /STS-3c/STS-1 SONET payload or AU4-64c/AU4-
16c/AU4-4C/AU-4/AU-3 SDH payload.
B3E1-4 is set high for one ROHCLK14 clock cycle for each
path BIP-8 error detected (up to eight errors per path per
frame).
When BIP-8 errors are treated on a block basis, B3E1-4 is set
high for one ROHCLK1 clock cycle for up to eight path BIP-8
errors detected (up to one error per path per frame).
Path BIP-8 errors are detected by comparing the extracted
path BIP-8 byte (B3) with the computed path BIP-8 byte of the
previous frame.
In STS-192/STM-64 mode, B3E1-4 is updated on the rising
edge of ROHCLK1. In STS-48/STM-16 mode, B3E1-4 is
updated on the rising edge of ROHCLK1-4.
13.6 Transmit Section/Line Overhead Insertion Signals
Pin Name
Type
Pin
No.
Function
TOHCLK1
TOHCLK2
TOHCLK3
TOHCLK4
Output
C13
A12
C12
A11
The
transmit overhead clock
(TOHCLK1-4) signal provides
timing for the transmit section and line overhead insertion.
These clocks are derived from the transmit line clocks
TXCLK1-4.
In STS-192/STM-64 mode, TOHCLK1 is a nominal 82.94 MHz
clock generated by gapping a 103.68 MHz clock. TOHCLK1
has a 50% nominal high duty cycle. TOHCLK2-4 are not
defined.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM5323-QC | |
| PM533 | Octal 12-Bit Rail-to-Rail DACs in 16-Lead SSOP; Package: SSOP; No of Pins: 16; Temperature Range: 0°C to +70°C |
| PM533DS | 12-Bit Rail-to-Rail DACs in 10-Lead DFN; Package: DFN; No of Pins: 10; Temperature Range: -40°C to +85°C |
| PM533K | Analog IC |
| PM533KS | Analog IC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PM5312 | 制造商:PMC 制造商全稱:PMC 功能描述:SONET/SDH Transport Overhead Terminating Transceiver |
| PM5313 | 制造商:PMC 制造商全稱:PMC 功能描述:SONET/SDH PAYLOAD EXTRACTOR/ALIGNER FOR 622 MBIT/S |
| PM5313-BI | 制造商:PMC-Sierra 功能描述: |
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