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參數(shù)資料
| 型號(hào)： | PM5311 |
| 英文描述： | ATM/SONET Transceiver |
| 中文描述： | ATM機(jī)/ SONET的收發(fā)器 |
| 文件頁數(shù)： | 361/544頁 |
| 文件大?。?/td> | 2537K |
| 代理商： | PM5311 |
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PM5317 SPECTRA-9953 Telecom Standard Product Data Sheet
Release
Proprietary and Confidential to PMC-Sierra, Inc., and for its customers’ internal use.
Document No.: PMC-2000741, Issue 5
361
S1REGEN
The S1 register enable (S1REGEN) bit controls the insertion of the synchronization status
message in the data stream. When S1REGEN is set to logic 1, the SSM from the TRMP
Transmit S1 and Z1 register is inserted in the S1 byte of STS-1/STM-0 #1 according to the
priority of Table 10. When S1REGEN is set to logic 0, the SSM from the TRMP Transmit
S1 and Z1 register is not inserted.
Z1REGEN
The Z1 register enable (Z1REGEN) bit controls the insertion of Z1 growth bytes in the data
stream. When Z1REGEN is set to logic 1, the Z1 byte from the TRMP Transmit S1 and Z1
register is inserted in the Z1 bytes according to the priority of Table 10. When Z1REGEN
is set to logic 0, the Z1 byte from the TRMP Transmit S1 and Z1 register is not inserted.
Z2REGEN
The Z2 register enable (Z2REGEN) bit controls the insertion of Z2 growth bytes in the data
stream. When Z2REGEN is set to logic 1, the Z2 byte from the TRMP Transmit Z2 and E2
register is inserted in the Z2 bytes according to the priority of Table 10. When Z2REGEN
is set to logic 0, the Z2 byte from the TRMP Transmit Z2 and E2 register is not inserted.
E2REGEN
The E2 register enable (E2REGEN) bit controls the insertion of line order wire in the data
stream. When E2REGEN is set to logic 1, the line order wire from the TRMP Transmit Z2
and E2 register is inserted in the E2 byte of STS-1/STM-0 #1 according to the priority of
Table 10. When E2REGEN is set to logic 0, the line order wire from the TRMP Transmit
Z2 and E2 register is not inserted.
NATIONALEN
The national enable (NATIONALEN) bit controls the insertion of national bytes in the data
stream. When NATIONALEN is set to logic 1, an all one or an all zero pattern is inserted
in the national bytes according to the priority of Table 10. When NATIONALEN is set to
logic 0, no pattern is inserted. The Z0DEF bit in the TRMP Configuration register defines
the national bytes of ROW #1.
NATIONALV
The national value (NATIONALV) bit controls the value inserted in the national bytes.
When NATIONALV is set to logic 1, an all one pattern is inserted in the national bytes if
enabled via the NATIONALEN register bit. When NATIONALV is set to logic 0, an all
zero pattern is inserted in the national bytes if enabled via the NATIONALEN register bit.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM5323-QC | |
| PM533 | Octal 12-Bit Rail-to-Rail DACs in 16-Lead SSOP; Package: SSOP; No of Pins: 16; Temperature Range: 0°C to +70°C |
| PM533DS | 12-Bit Rail-to-Rail DACs in 10-Lead DFN; Package: DFN; No of Pins: 10; Temperature Range: -40°C to +85°C |
| PM533K | Analog IC |
| PM533KS | Analog IC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| PM5313 | 制造商:PMC 制造商全稱:PMC 功能描述:SONET/SDH PAYLOAD EXTRACTOR/ALIGNER FOR 622 MBIT/S |
| PM5313-BI | 制造商:PMC-Sierra 功能描述: |
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