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參數(shù)資料
| 型號： | PM5311 |
| 英文描述： | ATM/SONET Transceiver |
| 中文描述： | ATM機/ SONET的收發(fā)器 |
| 文件頁數(shù)： | 47/544頁 |
| 文件大?。?/td> | 2537K |
| 代理商： | PM5311 |
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PM5317 SPECTRA-9953 Telecom Standard Product Data Sheet
Release
Proprietary and Confidential to PMC-Sierra, Inc., and for its customers’ internal use.
Document No.: PMC-2000741, Issue 5
47
Pin Name
Type
Pin
No.
Function
192 kHz clock 50 % duty cycle. When line DCC is selected,
RSLDCLK1-4 is a nominal 576 kHz clock with 50 % duty
cycle.
RSLD1-4 is updated on the falling edge of RSLDCLK1-4 and
ROHFP1-4 is used to identify the MSB of the D1 or the D4
byte on RSLD1-4.
The RRMP register contains the RSLD_SEL register bit used
to select the section or line DCC and the RSLD_TS register bit
that can be used to tri-state RSLDCLK1-4 and RSLD1-4
outputs.
RSLD1
RSLD2
RSLD3
RSLD4
Tristate
Output
AN6
AP5
AP6
AM7
The
receive section or line data communication channel
(RSLD1-4) signal contains the received section DCC (D1-D3)
or line DCC (D4-D12).
In STS-192/STM-64 mode, only RSLD1 is active. RSLD2-4 is
undefined.
RSLD1-4 is updated on the falling edge of RSLDCLK1-4 and
should be sampled externally on the rising edge of
RSLDCLK1-4. ROHFP1-4 is used to identify the MSB of the
D1 or the D4 byte on RSLD1-4.
The RRMP register contains the RSLD_SEL register bit used
to select the section or line DCC and the RSLD_TS register bit
that can be used to tri-state RSLDCLK1-4 and RSLD1-4
outputs.
RLDCLK1
RLDCLK2
RLDCLK3
RLDCLK4
Tristate
Output
AL9
AM8
AN7
AL8
The
receive line data communication channel clock
(RLDCLK1-4) signal is used to update the received line DCC
(RLD1-4).
In STS-192/STM-64 mode, only RLD1 is active. RLD2-4 is
undefined.
RLDCLK1-4 is a nominal 576 kHz clock 50 % duty cycle.
RLD1-4 is updated on the falling edge of RLDCLK1-4 and
ROHFP1-4 is used to identify the MSB of the D4 byte on
RLD1-4.
The RRMP register contains the RLD_TS register bit that can
be used to tri-state RLDCLK1-4 and RLD1-4 outputs.
RLD1
RLD2
RLD3
RLD4
Tristate
Output
AN10
AP9
AM11
AP10
The
receive line data communication channel
(RLD1-4)
signal contains the received line DCC (D4-D12).
In STS-192/STM-64 mode, only RLD1 is active. RLD2-4 is
undefined.
RLD1-4 is updated on the falling edge of RLDCLK1-4 and
should be sampled externally on the rising edge of RLDCLK1-
4. ROHFP1-4 is used to identify the MSB of the D4 byte on
RLD1-4.
The RRMP register contains the RLD_TS register bit that can
相關PDF資料 |
PDF描述 |
|---|---|
| PM5323-QC | |
| PM533 | Octal 12-Bit Rail-to-Rail DACs in 16-Lead SSOP; Package: SSOP; No of Pins: 16; Temperature Range: 0°C to +70°C |
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| PM533KS | Analog IC |
相關代理商/技術參數(shù) |
參數(shù)描述 |
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