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參數(shù)資料
| 型號(hào)： | PM5311 |
| 英文描述： | ATM/SONET Transceiver |
| 中文描述： | ATM機(jī)/ SONET的收發(fā)器 |
| 文件頁(yè)數(shù)： | 137/544頁(yè) |
| 文件大小： | 2537K |
| 代理商： | PM5311 |
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PM5317 SPECTRA-9953 Telecom Standard Product Data Sheet
Release
Proprietary and Confidential to PMC-Sierra, Inc., and for its customers’ internal use.
Document No.: PMC-2000741, Issue 5
137
Register 0003H: SP9953 Receive Configuration 3
Bit
Type
Function
Default
Bit 15
R/W
RSTS12CSL[16]
0
Bit 14
R/W
RSTS12CSL[15]
0
Bit 13
R/W
RSTS12CSL[14]
0
Bit 12
R/W
RSTS12CSL[13]
0
Bit 11
R/W
RSTS12CSL[12]
0
Bit 10
R/W
RSTS12CSL[11]
0
Bit 9
R/W
RSTS12CSL[10]
0
Bit 8
R/W
RSTS12CSL[9]
0
Bit 7
R/W
RSTS12CSL[8]
0
Bit 6
R/W
RSTS12CSL[7]
0
Bit 5
R/W
RSTS12CSL[6]
0
Bit 4
R/W
RSTS12CSL[5]
0
Bit 3
R/W
RSTS12CSL[4]
0
Bit 2
R/W
RSTS12CSL[3]
0
Bit 1
R/W
RSTS12CSL[2]
0
Bit 0
R/W
RSTS12CSL[1]
0
The Receive Configuration Register 3 is provided at SP9953 Read/Write Address 03H.
RSTS12CSL[1:16]
The receive STS-12 slave concatenation mode (RSTS12CSL[1:16]) bits enable the slave
processing of an STS-12c (VC-4-4c) payload for the corresponding STS-12/STM-4 slice.
When a logic 1 is written to RSTS12CSL[X] and a logic 1 is written to RSTS12C[X], the
receive STS-12/STM-4 slice process a slave STS-12c (VC-4-4c) payload. When a logic 0
is written to RSTS12CSL[X] and a logic 1 is written to RSTS12C[X], the receive STS-
12/STM-4 slice processes a master STS-12c (VC-4-4c) payload. When a logic 0 is written
to RSTS12CSL[X] and a logic 0 is written to RSTS12C[X], the receive STS-12/STM-4
slice is not processing an STS-12c (VC-4-4c) payload.
Note: there is a possibility that SVCA indirect registers can be corrupted upon path
reconfiguration. Refer to section 14.13 for more explanation and how to avoid the problem.
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