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參數(shù)資料
| 型號(hào)： | PM5311 |
| 英文描述： | ATM/SONET Transceiver |
| 中文描述： | ATM機(jī)/ SONET的收發(fā)器 |
| 文件頁數(shù)： | 177/544頁 |
| 文件大?。?/td> | 2537K |
| 代理商： | PM5311 |
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PM5317 SPECTRA-9953 Telecom Standard Product Data Sheet
Release
Proprietary and Confidential to PMC-Sierra, Inc., and for its customers’ internal use.
Document No.: PMC-2000741, Issue 5
177
SBIPEACCBLK
The section BIP error accumulation block (SBIPEACCBLK) bit controls the accumulation of
section BIP errors. When SBIPEACCBLK is set to logic 1, the section BIP accumulation
represents BIP-8 block errors (a maximum of 1 error per frame). When SBIPEACCBLK is set
to logic 0, the section BIP accumulation represents BIP-8 errors (a maximum of 8 errors per
frame).
LBIPEACCBLK
The line BIP error accumulation block (LBIPEACCBLK) bit controls the accumulation of
line BIP errors. When LBIPEACCBLK is set to logic 1, the line BIP accumulation
represents BIP-24 block errors (a maximum of 1 error per STS-3/STM-1 per frame). When
LBIPEACCBLK is set to logic 0, the line BIP accumulation represents BIP-8 errors (a
maximum of 8 errors per STS-1/STM-0 per frame).
LBIPEBERBLK:
The line BIP error BER block (LBIPEBERBLK) bit controls the indication of line BIP
errors for the BER. When LBIPEBERBLK is set to logic 1, the line BIP represents BIP-24
block errors (a maximum of 1 error per STS-3/STM-1 per frame). When LBIPEBERBLK
is set to logic 0, the line BIP represents BIP-8 errors (a maximum of 8 errors per STS-
1/STM-0 per frame).
LBIPEREIBLK
The line BIP error REI block (LBIPEREIBLK) bit controls the indication of line BIP errors
for the REI. When LBIPEREIBLK is set to logic 1, the line BIP represents BIP-24 block
errors (a maximum of 1 error per STS-3/STM-1 per frame saturated to 255). When
LBIPEREIBLK is set to logic 0, the line BIP represents BIP-8 errors (a maximum of 8
errors per STS-1/STM-0 per frame saturated to 255).
LREIACCBLK
The line REI accumulation block (LREIACCBLK) bit controls the extraction and
accumulation of line REI errors from the M1 byte. When LREIACCBLK is set to logic 1,
the extracted line REI are interpreted as block BIP-24 errors (a maximum of 1 error per
STS-3/STM-1 per frame). When LREIACCBLK is set to logic 0, the extracted line REI are
interpreted as BIP-8 errors (a maximum of 8 errors per STS-1/STM-0 per frame).
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM5323-QC | |
| PM533 | Octal 12-Bit Rail-to-Rail DACs in 16-Lead SSOP; Package: SSOP; No of Pins: 16; Temperature Range: 0°C to +70°C |
| PM533DS | 12-Bit Rail-to-Rail DACs in 10-Lead DFN; Package: DFN; No of Pins: 10; Temperature Range: -40°C to +85°C |
| PM533K | Analog IC |
| PM533KS | Analog IC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PM5312 | 制造商:PMC 制造商全稱:PMC 功能描述:SONET/SDH Transport Overhead Terminating Transceiver |
| PM5313 | 制造商:PMC 制造商全稱:PMC 功能描述:SONET/SDH PAYLOAD EXTRACTOR/ALIGNER FOR 622 MBIT/S |
| PM5313-BI | 制造商:PMC-Sierra 功能描述: |
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