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參數(shù)資料
| 型號(hào)： | PM5311 |
| 英文描述： | ATM/SONET Transceiver |
| 中文描述： | ATM機(jī)/ SONET的收發(fā)器 |
| 文件頁數(shù)： | 173/544頁 |
| 文件大?。?/td> | 2537K |
| 代理商： | PM5311 |
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PM5317 SPECTRA-9953 Telecom Standard Product Data Sheet
Release
Proprietary and Confidential to PMC-Sierra, Inc., and for its customers’ internal use.
Document No.: PMC-2000741, Issue 5
173
When WCIMODE is low, the CHANGEI register bit is cleared immediately after it is read,
thus acknowledging the event has been recorded. When WCIMODE is high, the
CHANGEI register bit is cleared immediately after a logic one is written to the CHANGEI
register, thus acknowledging the event has been recorded.
ERRORI
The delay line error event register bit (ERRORI) indicates the ERROR register bit has gone
high. When the ERROR register changes from a logic zero to a logic one, the ERRORI
register bit is set to logic one. If the ERRORE interrupt enable is high, the INT output is
also asserted when ERRORI asserts.
When WCIMODE is low, the ERRORI register bit is cleared immediately after it is read,
thus acknowledging the event has been recorded. When WCIMODE is high, the ERRORI
register bit is cleared immediately after a logic one is written to the ERRORI register, thus
acknowledging the event has been recorded.
REFCLKI
The reference clock event register bit REFCLKI provides a method to monitor activity on
the reference clock. When the REFCLK primary input changes from a logic zero to a logic
one, the REFCLKI register bit is set to logic one.
When WCIMODE is low, the REFCLKI register bit is cleared immediately after it is read,
thus acknowledging the event has been recorded. When WCIMODE is high, the REFCLKI
register bit is cleared immediately after a logic one is written to the REFCLKI register, thus
acknowledging the event has been recorded.
SYSCLKI
The system clock event register bit SYSLCKI provides a method to monitor activity on the
system clock. When the SYSCLK primary input changes from a logic zero to a logic one,
the SYSCLKI register bit is set to logic one. The SYSCLKI register bit is cleared
immediately after it is read, thus acknowledging the event has been recorded.
When WCIMODE is low, the SYSCLKI register bit is cleared immediately after it is read,
thus acknowledging the event has been recorded. When WCIMODE is high, the SYSCLKI
register bit is cleared immediately after a logic one is written to the SYSCLKI register, thus
acknowledging the event has been recorded.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM5323-QC | |
| PM533 | Octal 12-Bit Rail-to-Rail DACs in 16-Lead SSOP; Package: SSOP; No of Pins: 16; Temperature Range: 0°C to +70°C |
| PM533DS | 12-Bit Rail-to-Rail DACs in 10-Lead DFN; Package: DFN; No of Pins: 10; Temperature Range: -40°C to +85°C |
| PM533K | Analog IC |
| PM533KS | Analog IC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PM5312 | 制造商:PMC 制造商全稱:PMC 功能描述:SONET/SDH Transport Overhead Terminating Transceiver |
| PM5313 | 制造商:PMC 制造商全稱:PMC 功能描述:SONET/SDH PAYLOAD EXTRACTOR/ALIGNER FOR 622 MBIT/S |
| PM5313-BI | 制造商:PMC-Sierra 功能描述: |
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