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參數(shù)資料
| 型號： | PM5311 |
| 英文描述： | ATM/SONET Transceiver |
| 中文描述： | ATM機/ SONET的收發(fā)器 |
| 文件頁數(shù)： | 21/544頁 |
| 文件大小： | 2537K |
| 代理商： | PM5311 |
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PM5317 SPECTRA-9953 Telecom Standard Product Data Sheet
Release
Proprietary and Confidential to PMC-Sierra, Inc., and for its customers’ internal use.
Document No.: PMC-2000741, Issue 5
21
List of Tables
Table 1 Definitions.....................................................................................................................23
Table 2 Pin Diagram Left Side (Bottom View)...........................................................................38
Table 3 Pin Diagram Right Side (Bottom View) ........................................................................39
Table 4 A1/A2 Bytes Used for Out Of Frame Detection............................................................90
Table 5 A1/A2 Bytes Used for In Frame Detection ...................................................................90
Table 6 PLM-P, UNEQ-P and PDI-P Defects Declaration......................................................101
Table 7 Expected PDI Defects Based on PDI and PDI Range Values...................................102
Table 8 Ring Control Port Bit Definition...................................................................................104
Table 9 Maximum Line REI Errors Per Transmit Frame.........................................................106
Table 10 TOH Insertion Priority...............................................................................................108
Table 11 Definition of Z0/National Growth Bytes for Row #1..................................................110
Table 12 Path Overhead Byte Source Priority ........................................................................112
Table 13 Serial TelecomBus 8B/10B Character Mapping.......................................................118
Table 14 Serial TelecomBus 8B/10B Character Decoding.....................................................120
Table 15 SPECTRA-9953 Register Mapping Table................................................................123
Table 16 Test Mode Register Memory Map............................................................................466
Table 17 Instruction Register (Length - 3 bits)........................................................................479
Table 18 Identification Register...............................................................................................480
Table 19 Boundary Scan Register ..........................................................................................480
Table 20 Clocks for TSB Indirect Register Access .................................................................490
Table 21 Recommended SBER Settings for Different Data and BER Rates
Using Telcordia Objectives.................................................................................................492
Table 22 Recommended SBER Settings for Different Data and BER Rates
Using Telcordia and ITU Requirements..............................................................................492
Table 23 Functional Description of Path ERDI (PERDIINS) Encoding...................................500
Table 24 Absolute Maximum Ratings......................................................................................522
Table 25 D.C. Characteristics .................................................................................................523
Table 26 Power Requirements................................................................................................525
Table 27 Microprocessor Interface Read Access ...................................................................527
Table 28 Microprocessor Interface Write Access....................................................................528
Table 29 System Miscellaneous Timing..................................................................................530
Table 30 Line Interface Timing................................................................................................530
Table 31 System Interface Timing...........................................................................................531
Table 32 System Interface Control Pin Timing........................................................................532
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM5323-QC | |
| PM533 | Octal 12-Bit Rail-to-Rail DACs in 16-Lead SSOP; Package: SSOP; No of Pins: 16; Temperature Range: 0°C to +70°C |
| PM533DS | 12-Bit Rail-to-Rail DACs in 10-Lead DFN; Package: DFN; No of Pins: 10; Temperature Range: -40°C to +85°C |
| PM533K | Analog IC |
| PM533KS | Analog IC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PM5312 | 制造商:PMC 制造商全稱:PMC 功能描述:SONET/SDH Transport Overhead Terminating Transceiver |
| PM5313 | 制造商:PMC 制造商全稱:PMC 功能描述:SONET/SDH PAYLOAD EXTRACTOR/ALIGNER FOR 622 MBIT/S |
| PM5313-BI | 制造商:PMC-Sierra 功能描述: |
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