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參數(shù)資料
| 型號： | M32000D3FP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 66.6 MHz, RISC MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 20 MM, 0.65 MM PITCH, PLASTIC, LQFP-100 |
| 文件頁數(shù)： | 74/155頁 |
| 文件大?。?/td> | 1340K |
| 代理商： | M32000D3FP |
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M32000D3FP User's Manual
CPU
2-5
2.3 Control registers
2.3.2 Condition bit register: CBR (CR1)
The condition bit register (CBR) is a separate register which contains the condition bit (C) in the PSW. The
value of the condition bit (C) in the PSW is reflected in this register. This register is read-only. An attempt
to write to the CBR with the MVTC instruction is ignored.
31
0
CBR
C
0
2.3.3 Interrupt stack pointer:
SPI (CR2)
User stack pointer:
SPU (CR3)
The interrupt stack pointer (SPI) and the user stack pointer (SPU) retain the current stack address. The
SPI and SPU can be accessed as the general-purpose register R15. R15 switches between representing
the SPI and SPU depending on the value of the stack mode bit (SM) in the PSW.
31
0
SPI
SPU
31
0
SPI
2.3.4 Backup PC: BPC (CR6)
The backup PC (BPC) is the register where a copy of the PC value is saved when EIT occurs. Bit 31 is
fixed at "0". When EIT occurs, the PC value immediately before EIT occurrence or that of the next
instruction is set (For details, refer to Chapter 4 "EIT".). The value of the BPC is reloaded to the PC when
the RTE instruction is executed. However, the values of the lower 2 bits of the PC become "00" on
returning (It always returns to the word boundary).
31
0
BPC
0
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